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參數(shù)資料
| 型號： | Am79C965A |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | PCnet?-32 Single-Chip 32-Bit Ethernet Controller |
| 中文描述： | PCnet？-32單芯片32位以太網(wǎng)控制器 |
| 文件頁數(shù)： | 187/228頁 |
| 文件大?。?/td> | 1681K |
| 代理商： | AM79C965A |
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Am79C965A
187
SWITCHING CHARACTERISTICS: BUS INTERFACE
Parameter
Symbol
Parameter Description
Test Conditions
(C
L
= 50 pF
Unless Otherwise Noted)
Min
Max
Unit
Clock Timing
CLK Frequency
1
33
MHz
t
1
CLK Period
30
1000
ns
t
2
CLK High time
@ 2.0 V
14
ns
t
3
CLK Low Time
@ 0.8 V
14
ns
t
4
CLK Fall Time
2.0 V to 0.8 V (Note 1)
3
ns
t
5
CLK Rise Time
0.8 V to 2.0 V (Note 1)
3
ns
Output and Float Delay Timing
t
6
A2
–
A31, BE0
–
BE3, M/IO, D/C,
W/R, ADS, HOLD, HLDAO,
INTR, EADS, RDY Valid Delay
3
12
ns
t
7
A2
–
A31, BE0
–
BE3, M/IO, D/C,
W/R, ADS, RDY Float Delay
18
ns
t
8
ns
t
8a
BLAST Valid Delay
3
12
ns
t
9
BLAST Float Delay
18
ns
t
10
D0
–
D31 Data Valid Delay
3
12
ns
t
11
D0
–
D31 Data Float Delay
18
ns
t
12
(This symbol is not used)
t
13
(This symbol is not used)
Setup and Hold Timing
t
14
LBS16 Setup time
5
ns
t
15
LBS16 Hold Time
2
ns
t
16
BRDY, RDYRTN
Setup Time
5
ns
t
17
BRDY, RDYRTN Hold Time
2
ns
t
18
HOLDI, AHOLD, HLDA, SLEEP
Setup Time
6
ns
t
18a
BOFF Setup Time
8
ns
t
19
HOLDI, BOFF, AHOLD, HLDA,
SLEEP
Hold Time
2
ns
t
20
RESET, CLKRESET
Setup Time
5
ns
t
21
RESET, CLKRESET
Hold Time
2
ns
t
22
D0
–
D31, A2
–
A31, BE0
–
BE3,
ADS, M/IO, D/C, W/R
Setup Time
4
ns
t
23
D0
–
D31, A2
–
A31, BE0
–
BE3,
ADS, M/IO, D/C, W/R
Hold Time
2
ns
相關(guān)PDF資料 |
PDF描述 |
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