參數(shù)資料
型號(hào)： S1C33E07B
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 48 MHz, RISC MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.20 MM HEIGHT, 0.80 MM PITCH, PLASTIC, FBGA-180
文件頁數(shù)： 234/1018頁
文件大?。?/td> 6970K
代理商： S1C33E07B
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III PERIPHERAL MODULES 1 (SYSTEM): CLOCK MANAGEMENT UNIT (CMU)
III-1-20
EPSON
S1C33E07 TECHNICAL MANUAL
(2) Control register clock (SRAMSAPB_CLK)
This clock (MCLK) is used to control the SRAMC registers located in area 6. This clock is required for
accessing the SRAMC registers and it can be stopped when not in use. SRAMSAPB_CKE (D7/0x301B04) is
used for clock supply control (default: on).
SRAMSAPB_CKE: SRAMC SAPB Bus Interface Clock Control Bit in the Gated Clock Control Register 1
(D7/0x301B04)
III.1.9.6 Clock Supply to the GPIO
The CMU provides the clock paths with a control bit shown below for the GPIO. The clock supply turns on when
the control bit is set to 1 and it turns off when the control bit is set to 0.
(1) GPIO clock (PORT_CLK)
This clock (MCLK) is used for the GPIO circuit and is required for accessing the GPIO control registers.
GPIO_CKE (D8/0x301B04) is used for clock supply control (default: on).
GPIO_CKE: GPIO Normal Clock Control Bit in the Gated Clock Control Register 1 (D8/0x301B04)
(2) GPIO no stop clock (PORT_NOSTOP_CLK)
This clock (MCLK) is used for reading input ports and generating input interrupts. This clock can be
automatically turned off in HALT mode (see Section III.1.9.2) by setting GPIONSTP_HCKE (D27/0x301B04)
to 0 (default: on).
GPIONSTP_HCKE: GPIO No Stop Clock Control (HALT) Bit in the Gated Clock Control Register 1
(D27/0x301B04)
Note, however, that the GPIO no stop clock is required in HALT mode when using an input interrupt to cancel
HALT mode.
III.1.9.7 Clock Supply to the EFSIO
The CMU provides the clock paths with a control bit shown below for the EFSIO. The clock supply turns on when
the control bit is set to 1 and it turns off when the control bit is set to 0.
(1) Control register clock (EFSIOSAPB_CLK)
This clock (MCLK) is used to control the EFSIO registers located in area 6. This clock is required for accessing
the EFSIO registers and it can be stopped when not in use. EFSIOSAPB_CKE (D5/0x301B04) is used for clock
supply control (default: on).
EFSIOSAPB_CKE: EFSIO SAPB Bus Interface Clock Control Bit in the Gated Clock Control Register 1
(D5/0x301B04)
(2) EFSIO baud rate timer clock (EFSIO_BAUDRATE_CLK)
This clock (MCLK) is used as the source clock for the baud rate timer in EFSIO. This clock can be
automatically turned off in HALT mode (see Section III.1.9.2) by setting EFSIOBR_HCKE (D25/0x301B04) to
0 (default: on).
EFSIOBR_HCKE: EFSIO Baud Rate Clock Control (HALT) Bit in the Gated Clock Control Register 1
(D25/0x301B04)
III.1.9.8 Clock Supply to the USB
The CMU provides the clock paths with the control bit shown below for the USB module. The clock supply turns
on when the control bit is set to 1 and it turns off when the control bit is set to 0.
(1) USB clock (USB_CLK)
This clock (OSC3 = 48 MHz) is used for the USB interface module. USB_CKE (D8/0x301B00) is used for
clock supply control (default: off).
USB_CKE: USB IP 48 MHz Clock Control Bit in the Gated Clock Control Register 0 (D8/0x301B00)
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PDF描述
S2973 PIN PHOTO DIODE
S29AL004D90SFI013 256K X 16 FLASH 3V PROM, 90 ns, PDSO48
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S29AL008D90MAN012 Ceramic Chip Capacitors / High Voltage; Capacitance [nom]: 150pF; Working Voltage (Vdc)[max]: 500V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 0805; Termination: Tin (Sn) Plated Nickel Barrier; Body Dimensions: 0.079" x 0.049"; Container: Bulk; Features: High Voltage; Unmarked
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