參數(shù)資料
型號： S1C33E07B
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 48 MHz, RISC MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.20 MM HEIGHT, 0.80 MM PITCH, PLASTIC, FBGA-180
文件頁數(shù)： 822/1018頁
文件大小： 6970K
代理商： S1C33E07B
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IX PERIPHERAL MODULES 7 (USB): USB FUNCTION CONTROLLER (USB)
S1C33E07 TECHNICAL MANUAL
EPSON
IX-1-37
IX
USB
IX.1.5.2 Detailed Description of Registers
0x300900: MainIntStat (Main Interrupt Status)
Name
Address
Register name
Bit
Setting
Init. R/W
Remarks
SIE_IntStat
EPrIntStat
DMA_IntStat
FIFO_IntStat
–
EP0IntStat
RcvEP0SETUP
D7
D6
D5
D4
D3–2
D1
D0
0
–
0
R
–
R
R(W)
0 when being read.
00300900
(B)
1 SIE interrupts
0 None
1 EPr interrupts
0 None
1 DMA interrupts
0 None
1 FIFO interrupts
0 None
–
1 EP0 interrupts
0 None
1 Receive EP0 SETUP
0 None
MainIntStat
(Main interrupt
status)
This register displays causes of interrupt having occurred in the USB function controller. This register has the bit
indirectly showing causes of interrupt and the bit directly showing causes of interrupt.
The bit indirectly showing causes of interrupt can be traced to the bit directly showing causes of interrupt by
reading the relevant status registers. The bit showing causes of interrupt is read-only, and is automatically cleared
by clearing the bit directly showing causes of interrupt at the main source. The bits showing causes of interrupt are
writable, and the causes of interrupt can be cleared by setting the relevant bits to 1. When the corresponding bits
are enabled by the MainIntEnb register, setting the cause of interrupt to 1 asserts the #INT signal, and causes an
interruption of the CPU. Clearing all relevant causes of interrupt negates the #INT signal.
D7
SIE_IntStat
Shows a cause of interrupt indirectly.
When the SIE_IntStat register has a cause of interrupt and the SIE_IntEnb register bit corresponding to
the cause of interrupt is enabled, this bit is set to 1. Reading this bit is valid during snooze as well.
D6
EPrIntStat
Shows a cause of interrupt indirectly.
When the EPrIntStat register has a cause of interrupt and the EPrIntEnb register bit corresponding to
the cause of interrupt is enabled, this bit is set to 1.
D5
DMA_IntStat
Shows a cause of interrupt indirectly.
When the DMA_IntStat register has a cause of interrupt and the DMA_IntEnb register bit
corresponding to the cause of interrupt is enabled, this bit is set to 1.
D4
FIFO_IntStat
Shows a cause of interrupt indirectly.
When the FIFO_IntStat register has a cause of interrupt and the FIFO_IntEnb register bit corresponding
to the cause of interrupt is enabled, this bit is set to 1.
D[3:2]
Reserved
D1
EP0IntStat
Shows a cause of interrupt indirectly.
When the EP0IntStat register has a cause of interrupt and the EP0IntEnb register bit corresponding to
the cause of interrupt is enabled, this bit is set to 1.
D0
RcvEP0SETUP
Shows a cause of interrupt directly.
Set to 1 when the received data are set to the EP0Setup_0 to EP0Setup_7 after the set up stage has
been completed. At the same time, the ForceSTALL bit, the ForceNAK bit and the ToggleStat bit of the
EP0ControlIN and EP0ControlOUT registers are automatically set to 0, 1 and 1, respectively.
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PDF描述
S2973 PIN PHOTO DIODE
S29AL004D90SFI013 256K X 16 FLASH 3V PROM, 90 ns, PDSO48
S29AL008D90MAIR23 8 Megabit (1 M x 8-Bit/512 K x 16-Bit) CMOS 3.0 Volt-only Boot Sector Flash Memory
S29AL008D90MAN012 Ceramic Chip Capacitors / High Voltage; Capacitance [nom]: 150pF; Working Voltage (Vdc)[max]: 500V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 0805; Termination: Tin (Sn) Plated Nickel Barrier; Body Dimensions: 0.079" x 0.049"; Container: Bulk; Features: High Voltage; Unmarked
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