參數(shù)資料
型號： S1C33E07B
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 48 MHz, RISC MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.20 MM HEIGHT, 0.80 MM PITCH, PLASTIC, FBGA-180
文件頁數(shù)： 791/1018頁
文件大?。?/td> 6970K
代理商： S1C33E07B
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IX PERIPHERAL MODULES 7 (USB): USB FUNCTION CONTROLLER (USB)
IX-1-10
EPSON
S1C33E07 TECHNICAL MANUAL
Table IX.1.4.1.4 lists control items and statuses related to transaction processing on the EPa, EPb, EPc, and EPd
endpoints.
Table IX.1.4.1.4 Control Items and Statuses for Endpoints EPa, EPb, EPc, and EPd
Register/bit
EPx{x=a,b,c,d}Control.AutoForceNAK
EPx{x=a,b,c,d}Control.EnShortPkt
EPx{x=a,b,c,d}Control.
DisAF_NAK_Short
EPx{x=a,b,c,d}Control.ToggleStat
EPx{x=a,b,c,d}Control.ToggleSet
EPx{x=a,b,c,d}Control.ToggleClr
EPx{x=a,b,c,d}Control.ForceNAK
EPx{x=a,b,c,d}Control.ForceSTALL
EPx{x=a,b,c,d}IntStat.OUT_ShortACK,
EPx{x=a,b,c,d}IntStat.IN_TranACK,
EPx{x=a,b,c,d}IntStat.OUT_TranACK,
EPx{x=a,b,c,d}IntStat.IN_TranNAK,
EPx{x=a,b,c,d}IntStat.OUT_TranNAK,
EPx{x=a,b,c,d}IntStat.IN_TranErr,
EPx{x=a,b,c,d}IntStat.OUT_TranErr
Description
Sets the endpoint's EPx{x=a,b,c,d}Control.ForceNAK
bit whenever an OUT transaction is completed.
Enables transmission of short packets that are under
the maximum packet size for IN transactions. This
setting is cleared after the IN transaction that has
transmitted a short packet is completed.
In OUT transactions, reception of a short packet
automatically disables the function that sets the
endpoint's EPx{x=a,b,c,d}Control.ForceNAK bit.
Indicates the state of the toggle sequence bit.
Sets the toggle sequence bit.
Clears the toggle sequence bit.
Returns a NAK response to a transaction regardless of
the number of data or vacancies in the FIFO region.
Returns a STALL response to the transaction.
Indicates the result of the transaction.
Item
Set automatic
ForceNAK
Enable short packet
transmission
Disable automatic
ForceNAK setting
upon short packet
reception
Toggle sequence bit
Set toggle
Clear toggle
Forced NAK
response
STALL response
Transaction status
SETUP transaction
The SETUP transaction addressed to the EP0 endpoint of the macro's own node is automatically executed. (The
USB function must be enabled for this to happen.)
When a SETUP transaction is issued, all the contents of the data packet (8 bytes) are stored in the registers
EP0Setup_0 through EP0Setup_7, followed by an ACK response. Meanwhile, a RcvEP0SETUP status is issued
to the firmware.
If an error occurs during a SETUP transaction, no response or status is issued.
When the SETUP transaction is completed, the ForceNAK bit of the EP0ControlIN and EP0ControlOUT
registers are set and the ForceSTALL bit is cleared. The ToggleStat bit is also set. After the firmware completes
setting the EP0 endpoint and becomes ready to proceed to the next stage, clear the ForceNAK bit of the relevant
direction in the EP0ControlIN or EP0ControlOUT register.
Figure IX.1.4.1.1 illustrates how the SETUP transaction is executed.
(a) The host issues a SETUP token addressed to the EP0 endpoint of this node.
(b) Next, the host sends an 8-byte long data packet. The macro writes these data in the EP0Setup_0 through
EP0Setup_7 registers.
(c) The macro automatically returns an ACK response. In addition, it sets registers to be automatically set up
and issues a status to the firmware.
SETUP
a
ACK
c
DATA
b
Host to Device
Device to Host
Figure IX.1.4.1.1 SETUP Transaction
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PDF描述
S2973 PIN PHOTO DIODE
S29AL004D90SFI013 256K X 16 FLASH 3V PROM, 90 ns, PDSO48
S29AL008D90MAIR23 8 Megabit (1 M x 8-Bit/512 K x 16-Bit) CMOS 3.0 Volt-only Boot Sector Flash Memory
S29AL008D90MAN012 Ceramic Chip Capacitors / High Voltage; Capacitance [nom]: 150pF; Working Voltage (Vdc)[max]: 500V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 0805; Termination: Tin (Sn) Plated Nickel Barrier; Body Dimensions: 0.079" x 0.049"; Container: Bulk; Features: High Voltage; Unmarked
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