參數(shù)資料
型號(hào)： T7630
英文描述： T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)
中文描述： T7630雙T1/E1的5.0V的短途終結(jié)者（終結(jié)者-Ⅱ）
文件頁數(shù)： 128/210頁
文件大?。?/td> 3075K
代理商： T7630
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Preliminary Data Sheet
October 2000
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator II)
128
L Lucent Technologies Inc.
Microprocessor Interface
(continued)
In modes 1 and 3, asserting ALE_AS signal low is used to enable the internal address bus. In modes 2 and 4, the
falling edge of ALE_AS signal is used to latch the address bus.
Table 67. Microprocessor Interface I/O Timing Specifications
Symbol
Configuration
Parameter
Setup
(ns)
(Min)
Hold
(ns)
(Min)
Delay
(ns)
(Max)
t1
Modes 1 & 2
AS Asserted Width
—
10
—
t2
Address Valid to AS Deasserted
10
—
—
t3
AS Deasserted to Address Invalid
—
10
—
t4
—
—
—
—
t5
R/W Valid to Both CS and DS Asserted
4
—
—
t6
Address Valid and AS Asserted to DS Asserted
(Read)
0
—
—
t7
CS Asserted to DTACK Low Impedance
—
—
12
t8
DS Asserted to DTACK Asserted
—
—
15
t9
DS Asserted to AD Low Impedance (Read)
—
—
15
t10
DTACK Asserted to Data Valid
—
—
25
t11
DS Deasserted to CS Deasserted (Read)
—
5
—
t12
DS Deasserted to R/W Invalid
—
5
—
t13
DS Deasserted to DTACK Deasserted
—
—
12
t14
CS Deasserted to DTACK High Impedance
—
10
t15
DS Deasserted to Data Invalid (Read)
—
5
—
t16
Address Valid and AS Asserted to DS Asserted
(Write)
10
—
—
t17
Data Valid to DS Asserted
10
—
—
t18
DS Deasserted to CS Deasserted (Write)
—
5
—
t19
DS Deasserted to Data Valid
—
10
—
t20
DS Asserted Width (Write)
—
10
—
t21
Address Valid to AS Falling Edge
10
—
—
t22
AS Falling Edge to Address Invalid
—
10
—
t23
AS Falling Edge to DS Asserted (Read)
0
—
—
t24
AS Falling Edge to DS Asserted (Write)
10
—
—
t25
CS Asserted to DS Asserted (Write)
10
—
—
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PDF描述
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)(雙 T1/E1 5.0V短距離通信終端器)
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