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參數(shù)資料
| 型號： | T7630 |
| 英文描述： | T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II) |
| 中文描述： | T7630雙T1/E1的5.0V的短途終結(jié)者（終結(jié)者-Ⅱ） |
| 文件頁數(shù)： | 184/210頁 |
| 文件大小： | 3075K |
| 代理商： | T7630 |
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Preliminary Data Sheet
October 2000
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator II)
184
L Lucent Technologies Inc.
Framer Register Architecture
(continued)
CHI Common Control Register (FRM_PR46)
This register defines the common attributes of the transmit and receive CHI. The default value is 00 (hex).
Table 169. CHI Common Control Register (FRM_PR46) (68E; C8E)
CHI Transmit Control Register (FRM_PR47)
The default value of this register is 00 (hex).
Table 170. CHI Transmit Control Register (FRM_PR47) (68F; C8F)
CHI Receive Control Register (FRM_PR48)
The default value of this register is 00 (hex).
Table 171. CHI Receive Control Register (FRM_PR48) (690; C90)
Bit
0—2
Symbol
TOFF0—
TOFF2
Description
Transmit CHI Bit Offset.
These 3 bits define the bit offset from TCHIFS for each trans-
mit time slot. The offset is the number of TCHICK clock periods by which the first bit is
delayed from TCHIFS.
Transmit Frame Clock Edge.
A 0 (1) enables the falling (rising) edge of TCHICK to
latch in the frame synchronization signal, TCHIFS.
Receive CHI Bit Offset.
These 3 bits define the bit offset from RCHIFS for each
received time slot. The offset is the number of RCHICK clock periods by which the first
bit is delayed from RCHIFS.
Received Frame Clock Edge.
A 0 (1) enables the falling (rising) edge of RCHICK to
latch in the frame synchronization signal, RCHIFS.
3
TFE
4—6
ROFF0—
ROFF2
7
RFE
Bit
0—5
Symbol
TBYOFF0—
TBYOFF5
Description
Transmit Byte Offset.
Combined with FRM_PR65 bit 0 (TBYOFF6), these 6 bits define
the byte offset from TCHIFS to the beginning of the next transmit CHI frame on TCHI-
DATA.
Transmitter Clock Edge.
A 1 (0) enables the rising (falling) edge of TCHICK to clock out
data on TCHIDATA.
Reserved.
Write to 0.
6
TCE
7
—
Bit
0—5
Symbol
RBYOFF0—
RBYOFF5
Description
Receiver Byte Offset.
Combined with FRM_PR66 bit 0 (RBYOFF6), these 6 bits define
the byte offset from RCHIFS to the beginning of the next receive CHI frame on RCHI-
DATA.
Receiver Clock Edge.
A 1 (0) enables the rising (falling) edge of RCHICK to latch
data on RCHIDATA.
Reserved.
Write to 0.
6
RCE
7
—
相關PDF資料 |
PDF描述 |
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