參數(shù)資料
型號(hào): T7630
英文描述: T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)
中文描述: T7630雙T1/E1的5.0V的短途終結(jié)者(終結(jié)者-Ⅱ)
文件頁(yè)數(shù): 189/210頁(yè)
文件大?。?/td> 3075K
代理商: T7630
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Lucent Technologies Inc.
Lucent Technologies Inc.
189
Preliminary Data Sheet
October 2000
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)
Framer Register Architecture
(continued)
Transmit Signaling Registers: DS1 Format (FRM_TSR0—FRM_TSR23)
These registers program the transmit signaling registers for the DS1 and CEPT mode. The default value of these
registers is 00 (hex).
Table 180. Transmit Signaling Registers: DS1 Format (FRM_TSR0—FRM_TSR23) ((6E0—6F7); (CE0—CF7))
Transmit Signaling Registers: CEPT Format (FRM_TSR0—FRM_TSR31)
Table 181. Transmit Signaling Registers: CEPT Format (FRM_TSR0—FRM_TSR31) ((6E0—6FF);
(CE0—CFF))
* In PCS0 or PCS1 signaling mode, this bit is undefined.
Transmit Signal Registers
Bit 7
P
X
Bit 6
G
0
Bit 5
F
0
Bit 4
X
X
Bit 3
D
D
Bit 2
C
C
Bit 1
B
B
Bit 0
A
A
DS1 Transmit Signaling Registers (0—23)
ESF Format: Voice Channel with 16-State Signaling
SLC-96: 9-State Signaling (depending on the setting in
register FRM_PR43)
Voice Channel with 4-State Signaling
Voice Channel with 2-State Signaling
Data Channel (no signaling)
X
X
X
0
1
1
1
1
0
X
X
X
X
X
X
X
X
X
B
A
X
A
A
X
Transmit Signal Registers
FRM_TSR1—FRM_TSR15
FRM_TSR17—FRM_TSR31
Bit 7
P
P
Bit 6—5
X
X
Bit 4
*
E[1:15]
E[17:31]
Bit 3
D[1:15]
D[17:31]
Bit 2
C[1:15]
C[17:31]
Bit 1
B[1:15]
B[17:31]
Bit 0
A[1:15]
A[17:31]
相關(guān)PDF資料
PDF描述
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)(雙 T1/E1 5.0V短距離通信終端器)
T8100A H.100/H.110 Interface and Time-Slot Interchangers
T8102A H.100/H.110 Interface and Time-Slot Interchangers
T8105A H.100/H.110 Interface and Time-Slot Interchangers
T8100 H.100/H.110 Interface and Time-Slot Interchanger
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