參數(shù)資料
型號: T7630
英文描述: T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)
中文描述: T7630雙T1/E1的5.0V的短途終結(jié)者(終結(jié)者-Ⅱ)
文件頁數(shù): 164/210頁
文件大?。?/td> 3075K
代理商: T7630
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Preliminary Data Sheet
October 2000
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator II)
164
L Lucent Technologies Inc.
Framer Register Architecture
(continued)
Primary Interrupt Enable Register (FRM_PR0)
The default value of this register is 00 (hex).
Table 126. Primary Interrupt Group Enable Register (FRM_PR0) (660; C60)
Bit
0
1
2
Symbol
SR1IE
SR2IE
SR34IE
Description
Status Register 1 Interrupt Enable Bit.
A 1 enables register FRM_SR1 event interrupts.
Status Register 2 Interrupt Enable Bit.
A 1 enables register FRM_SR2 event interrupts.
Status Registers 3 and 4 Interrupt Enable Bit.
A 1 enables registers FRM_SR3 and
FRM_SR4 event interrupts.
Status Registers 5, 6, and 7 Interrupt Enable Bit.
A 1 enables registers FRM_SR5,
FRM_SR6, and FRM_SR7 event interrupts.
Transmit Signaling Ready Interrupt Enable Bit.
A 1 enables interrupts when transmit
signaling buffers are ready (MOS mode).
Receive Signaling Ready Interrupt Enable Bit.
A 1 enables interrupts when receive sig-
naling buffers are ready (MOS mode).
Reserved
. Write to 0.
SLC-96 Interrupt Enable Bit.
A 1 enables interrupts when SLC-96 receive or transmit
stacks are ready.
3
SR567IE
4
TSRIE
5
RSRIE
6
7
SLCIE
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PDF描述
T7630 Dual T1/E1 5.0 V Short-Haul Terminator (Terminator-II)(雙 T1/E1 5.0V短距離通信終端器)
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