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參數(shù)資料
| 型號(hào)： | V363EPC-50 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁(yè)數(shù)： | 121/190頁(yè) |
| 文件大小： | 1105K |
| 代理商： | V363EPC-50 |
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Copyright 1997-2000, V3 Semiconductor Inc.
EPC User
’
s Manual Revision 1.05
111
Chapter 13
Interrupt Control
The EPC includes two Interrupt Control Units (ICUs): one to process interrupt requests
bound for the local CPU, and one to process interrupt requests to and from the PCI bus. The
two Interrupt Control Units are connected to allow the routing of interrupt requests from PCI
to the Local bus, as well as from the Local bus to PCI.
The PCI Interrupt Control Unit (PICU) also includes a special crosspoint interrupt routing
mechanism for the four PCI interrupt requests (INTA through INTD). Each of the four PCI
interrupts can function as either an input or an output, and interrupt requests may be passed
from any PCI interrupt to any other PCI interrupt. PCI interrupt acknowledge cycles can also
be generated by the EPC when acting as a host bridge.
13.1
LOCAL INTERRUPT CONTROL UNIT
The Local Interrupt Control Unit (LICU) process interrupts from the following sources:
PCI read and write exceptions
DMA chain completion
Mailbox register access (
“
doorbell
”
interrupt)
PCI Interrupt pin events
13.1.1
Overview
The LICU consists of an interrupt status register (LB_ISTAT) and an interrupt mask register
(LB_IMASK) as shown in Figure 56. Interrupt requests from the individual sources are
posted in the interrupt status register. The interrupt mask register controls which of the
interrupt requests posted in the request register actually generate an interrupt request to the
local processor, and optionally, the PCI Interrupt Control Unit.
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