參數(shù)資料
型號(hào): V363EPC-50
英文描述: Controller Miscellaneous - Datasheet Reference
中文描述: 控制器雜項(xiàng)-數(shù)據(jù)表參考
文件頁數(shù): 91/190頁
文件大?。?/td> 1105K
代理商: V363EPC-50
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Local Bus Interface
Master Mode
Copyright 1997-2000, V3 Semiconductor Inc.
EPC User
s Manual Revision 1.05
81
Figure 39: V360EPC (292 mode) Local Bus Master Access (Strict Compatibility Mode)
8.2.5.2
High-Performance Mode
In systems that choose to use high-performance mode, both BURST and LREQ are
asserted as soon as the V360EPC (292 mode) begins a cycle (LCLK 1 and LCLK 3 in Figure
40). If the cycle is a non-burst cycle then BURST is de-asserted on the next cycle (LCLK2).
If a burst is really going to happen then BURST remains asserted until before the last data
transfer of the burst (LCLK 6) as it normally would. If the local bus slave devices don
t care
about the state of BURST on the first cycle then the high performance mode will save one
cycle and should be used by setting the FAST_REQ bit in the SYSTEM register.
The V360EPC (292 mode) defaults to strict compatibility mode following reset. The local bus
mode is changed by writing to the FAST_REQ bit in the SYSTEM register. System using the
V292BMC/CMC Burst DRAM Controller or the V380SDC SDRAM Controller can take
advantage of the high performance mode and will also work when strict compatibility mode
is selected.
Figure 40: V360EPC (292 mode) Local Bus Master Access (High-Performance Mode))
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PDF描述
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