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參數(shù)資料
| 型號： | AM79C965KCW |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 3 CHANNEL(S), LOCAL AREA NETWORK CONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數(shù)： | 186/220頁 |
| 文件大?。?/td> | 1197K |
| 代理商： | AM79C965KCW |
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AMD
P R E L I M I N A R Y
68
Am79C965
Figure 16 illustrates an example of an interrupted linear
burst. Note that
BLAST is asserted in the fourth transfer
after the initial linear burst began, even though the linear
burst was interrupted with the assertion of
RDYRTN and
a new
ADS was driven for the third transfer. The external
effect of the
RDYRTN interruption is completely mani-
fested in the insertion of the T1 cycle that contains the
asserted
ADS. The linear burst cycle is not affected in
any other way.
Partial Linear Burst
Certain factors may cause the PCnet-32 controller to
linearly burst fewer than the LINBC limit during a single
linear burst sequence.
BLAST will be asserted during
the last data transfer. A linear burst that is terminated by
BLAST before the LINBC limit is reached is called a par-
tial linear burst.
A partial linear burst is recognizable in that the
BLAST
signal is asserted while fewer than the LINBC limit of
transfers has been performed in the current linear burst
sequence.
Factors that could generate a partial linear burst include:
s No more data available for transfers from the current
transmit buffer
s No more data available for transfer from the receive
FIFO
for this packet
s No more space available for transfers to the current
receive buffer
If any of these conditions occurs, then the PCnet-32
controller will end the Linear Burst by asserting
BLAST.
Typically, during the case of a master
read operation (for
transmit buffer transfers), the last transfer in the linear
burst sequence will be the last transfer executed before
the PCnet-32 controller releases the bus. This is true of
both partial and completed linear burst sequences.
18219B-19
ADS
Ti
BCLK
T1
T2
T1
T2
T1
A4-A31,
M/
IO,
D/
C
A2-A3,
BE0-BE3
RDYRTN
W/
R
BRDY
BLAST
D0-D31
T2
From
PCnet-32
HOLD
HLDA
From
PCnet-32
From
PCnet-32 From
PCnet-32
From
PCnet-32
Ti
Figure 16. “Interrupted” Linear Burst Write
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AM80A-024L-120F18 | 1-OUTPUT 240 W DC-DC REG PWR SUPPLY MODULE |
| AJ80A-024L-033F50 | 1-OUTPUT 240 W DC-DC REG PWR SUPPLY MODULE |
| AM93LC66S | 4096-bits Serial Electrically Erasable PROM |
| AM93LC66SA | 4096-bits Serial Electrically Erasable PROM |
| AM93LC66VN | 4096-bits Serial Electrically Erasable PROM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AM79C970 | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnetTM-PCI Single-Chip Ethernet Controller for PCI Local Bus |
| AM79C970A | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnet-PCI II Single-Chip Full-Duplex Ethernet Controller for PCI Local Bus Product |
| AM79C970AKC | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:PCnet-PCI II Single-Chip Full-Duplex Ethernet Controller for PCI Local Bus Product |
| AM79C970AKC\\W | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Advanced Micro Devices 功能描述: |
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