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參數(shù)資料
| 型號： | XPC801ZP25 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 244/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP25 |
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External Bus Interface
MOTOROLA
MPC801 USER’S MANUAL
13-7
13
NOTES:
O = Output from the MPC801.
I = Input to the MPC801.
TEA
1
Low
I
Transfer Error Acknowledge
current transaction was addressed to. It indicates that an error
condition has occurred during the bus cycle.
—Driven by the slave device the
O
Driven by the MPC801 when the internal bus monitor
erroneous bus condition.
detects an
BI
1
Low
I
Burst Inhibit
was addressed to. It indicates that the current slave does not
support burst mode.
—Driven by the slave device the current transaction
O
Driven by the MPC801 when the slave device is controlled by the
on-chip memory controller.
ARBITRATION
BR
1
Low
I
Bus Request
that an external master is requesting the bus.
—When the internal arbiter is asserted, it indicates
O
Driven by the MPC801 when the internal arbiter is disabled and
the chip is not parked
.
BG
1
Low
O
Bus Grant
asserts this signal to indicate that an external master can assume
ownership of the bus and begin a bus transaction. The BG signal
should be qualified by the master requesting the bus to ensure it
is the bus owner:
Qualified BG = BG & ~ BB
—When the internal arbiter is enabled, the MPC801
I
When the internal arbiter is disabled, the BG is sampled and
properly qualified by the MPC801 when an external bus
transaction is to be executed by the chip.
BB
1
Low
O
Bus Busy
asserts this signal to indicate that it is the current owner of the
bus. When the internal arbiter is disabled, it will assert this signal
after the external arbiter grants the chip ownership of the bus and
it is ready to start the transaction.
—When the internal arbiter is enabled, the MPC801
I
When the internal arbiter is enabled, the MPC801 samples this
signal to get an indication of when the external master ended its
bus tenure (BB negated).
When the internal arbiter is disabled, the BB is sampled to
properly qualify the BG signal when an external bus transaction
is to be executed by the chip.
Table 13-1. MPC801 System Interface Unit Signals (Continued)
MNEMONIC
PINS
ACTIVE
I/O
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XPC801ZP40 | Microprocessor |
| XPC821ZP40 | Microprocessor |
| XPC823ZP25 | Microprocessor |
| XPC823ZP50 | Microprocessor |
| XPC8241LZP166 | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XPC801ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| XPC821ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| XPC823CVR66B2T | 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| XPC823CZC66A | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2 | 制造商:Freescale Semiconductor 功能描述: |
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