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參數(shù)資料
| 型號： | XPC801ZP25 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 44/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP25 |
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External Signals
MOTOROLA
MPC801 USER’S MANUAL
2-7
2
IWP2
VF2
F1
Instruction Watchpoint 2
program flow executed by the internal core.
Visible Instruction Queue Flush Status
the MPC801 when you need program instructions flow tracking. VF
flushed from the instruction queue in the internal core.
—This output signal reports the detection of an instruction watchpoint in the
—This output signal, together with VF0 and VF1, is output by
x
reports the number of instructions
LWP0
VF0
F2
Load/Store Watchpoint 0
program flow executed by the internal core.
Visible Instruction Queue Flushes Status
output by the MPC801 when you need program instructions flow tracking. VF reports the number of
instructions flushed from the instruction queue in the internal core.
—This output signal reports the detection of a data watchpoint in the
—This output signal, combined with VF1 and VF2, is
LWP1
VF1
G3
Load/Store Watchpoint 1
program flow executed by the internal core.
Visible Instruction Queue Flushes Status
output by the MPC801 when you need program instructions flow tracking. VF reports the number of
instructions flushed from the instruction queue in the internal core.
—This output signal reports the detection of a data watchpoint in the
—This output signal, combined with VF0 and VF2, is
DSDI
IRQ5
I3
Development Serial Data Input
Interrupt Request 5
internal interrupt controller, a service routine from the core. It should be noted that the interrupt request
signal that is sent to the interrupt controller is the logical AND of this signal (if defined to function as
IRQ5) and the DP2/IRQ5 (if defined to function as IRQ5).
—This input signal is the data in for the debug port interface.
—This input signal is one of the eight external signals that can request through the
PTR
AT3
H3
Program Trace
place to allow program flow tracking.
Address Type 3
—This bidirectional three-state signal is driven by the MPC801 when it initiates a
transaction on the external bus. When the transaction is initiated by the internal core, it indicates if the
transfer is reserved for data transfers or a program trace indication for instructions fetch.
—This output signal is asserted by the MPC801 to indicate an instruction fetch is taking
MODCK1
STS
J3
Mode Clock 1
of operation.
Special Transfer Start
transaction on the external bus or to signal the beginning of an internal transaction in show cycle mode.
—This input signal is sampled at PORESET negation to configure the PLL/clock mode
—This output signal is driven by the MPC801 to indicate the start of a
MODCK2
DSDO
J2
Mode Clock 2
of operation.
Development Serial Data Output
—This input signal is sampled at PORESET negation to configure the PLL/clock mode
—This output signal is the data out of the debug port interface.
BADDR[28:30]
J1, I1, and H1
Burst Address
These signals are used by the memory controller to allow increments in the address lines that connect
to memory devices when a synchronous external or internal master initiates a burst transfer.
—These output signals duplicate the value of A[28:29] when:
An internal master in the MPC801 initiates a transaction on the external bus.
An asynchronous external master initiates a transaction.
A synchronous external master initiates a single beat transaction.
AS
I4
Address Strobe
address on the A[6:31] signals. The memory controller in the MPC801 synchronizes this signal and
controls the memory device addressed under its control.
—This input signal is driven by an external asynchronous master to indicate a valid
PB[31]
SPISEL
F16
General-Purpose I/O Port B Bit 31
SPISEL
—This is the serial peripheral interface slave select input pin.
—This is Bit 31 of the general-purpose I/O port B.
PB[30]
SPICLK
G13
General-Purpose I/O Port B Bit 30
SPICLK
—This is the serial peripheral interface output clock when it is configured as a master or serial
peripheral interface input clock when it is configured as a slave.
—This is Bit 30 of the general-purpose I/O port B.
Table 2-1. Signal Descriptions (Continued)
PIN NAME
PIN NUMBER
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XPC801ZP40 | Microprocessor |
| XPC821ZP40 | Microprocessor |
| XPC823ZP25 | Microprocessor |
| XPC823ZP50 | Microprocessor |
| XPC8241LZP166 | Microprocessor |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XPC801ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| XPC821ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| XPC823CVR66B2T | 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| XPC823CZC66A | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2 | 制造商:Freescale Semiconductor 功能描述: |
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