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參數(shù)資料
| 型號(hào)： | V4ECFUM |
| 英文描述： | ColdFire CF4e Core User＇s Manual |
| 中文描述： | 核心的ColdFire CF4e用戶手冊(cè) |
| 文件頁(yè)數(shù)： | 16/372頁(yè) |
| 文件大?。?/td> | 4286K |
| 代理商： | V4ECFUM |
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ILLUSTRATIONS
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Title
Page
Number
xvi
ColdFire CF4e Core User’s Manual
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EMAC Register Set.......................................................................................................5-6
MAC Status Register (MACSR)...................................................................................5-7
Two’s Complement, Signed Fractional Equation.......................................................5-13
CF4e ColdFire Processor Complex Block Diagram.....................................................6-3
OAGComputeEngine Register Renaming Resources...................................................6-8
Sequence-Related OEP Sequence Stall ......................................................................6-11
EMAC-Specific OEP Sequence Stall.........................................................................6-14
for_loop Example........................................................................................................6-16
CF4e Ex Execute Engines within the OEP.................................................................6-17
Exception Stack Frame.................................................................................................7-4
Generic CF4e Block Diagram.......................................................................................8-2
Local Memory Block Diagram Showing Cache, KRAM, and KROM Controllers.....8-3
ColdFire Core Synchronous Memory Interface............................................................8-4
Synchronous Memory Timing Diagram.......................................................................8-4
Synchronous Memory Interface Block Diagram..........................................................8-5
Version 4 Cache Block Diagram..................................................................................8-7
Cache Organization and Line Format (32-Kbyte Cache Size Shown).......................8-14
Cache Organization and Line Format (32 Kbyte Cache Size shown)........................8-19
SRAM Base Address Registers (RAMBARn) ...........................................................8-24
ROM Base Address Registers (ROMBAR0/ROMBAR1).........................................8-29
Data Cache Organization and Line Format ................................................................8-34
Data Cache—A: at Reset, B: after Invalidation, C and D: Loading Pattern...............8-35
Data Caching Operation..............................................................................................8-36
Write-Miss in Copyback Mode...................................................................................8-41
Data Cache Locking....................................................................................................8-45
Cache Control Register (CACR) ................................................................................8-46
Access Control Register Format (ACRn)...................................................................8-49
An Format (Data Cache).............................................................................................8-50
An Format (Instruction Cache)...................................................................................8-50
Instruction Cache Line State Diagram........................................................................8-52
Data Cache Line State Diagram—Copyback Mode...................................................8-54
Data Cache Line State Diagram—Write-Through Mode...........................................8-54
Generic CF4e Block Diagram.......................................................................................9-1
Basic Read and Write Cycles........................................................................................9-9
Pipelined Read and Write...........................................................................................9-10
Address Hold Followed By 1- and 0-Wait State Cycles.............................................9-11
mapb and mahb Generated Mid-Data Phase...............................................................9-12
mahb Generation for 1X Clock Mode ........................................................................9-12
LIne Access Read with Zero Wait States ...................................................................9-14
Line Access Read with One Wait State......................................................................9-15
Line Access Write with Zero Wait States...................................................................9-15
Line Access Write with One Wait State.....................................................................9-16
Multiplexed M-Bus Structure.....................................................................................9-16
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V4F-1J-01V | HYBRIDKARTENLESER |
| V4F-1J-01V565246 | READER CARD |
| V4NS | MICROSWITCH PLUNGER |
| V4NST7 | MICROSWITCH PLUNGER |
| V4NST8 | MICROSWITCH PLUNGER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| V4F-10P | 功能描述:3M PELTOR CLEAR POLYCARB 制造商:3m 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1 |
| V4FFS12V40A | 制造商:TDK 功能描述:Vega universal input SMPSU,12V 450W |
| V4FFS24V15A | 制造商:TDK 功能描述:Vega universal input SMPSU,24V 450W |
| V4FFS5V60A,12V12A,12V12A,24V6 | 制造商:TDK 功能描述:Vega univ input SMPSU,5/2x12/24V 450W |
| V4FFS5Z18F12C3F12B3F | 制造商:TDK 功能描述:Vega universal input SMPSU,5/2x12V 450W |
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