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參數(shù)資料
| 型號(hào)： | V4ECFUM |
| 英文描述： | ColdFire CF4e Core User＇s Manual |
| 中文描述： | 核心的ColdFire CF4e用戶手冊(cè) |
| 文件頁數(shù)： | 18/372頁 |
| 文件大?。?/td> | 4286K |
| 代理商： | V4ECFUM |
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ILLUSTRATIONS
Figure
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11-32
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Title
Page
Number
xviii
ColdFire CF4e Core User’s Manual
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Go to: www.freescale.com
fill Command Format................................................................................................11-43
fill Command Sequence............................................................................................11-44
go Command Sequence.............................................................................................11-45
go Command Format................................................................................................11-45
nop Command Sequence...........................................................................................11-46
nop Command Format..............................................................................................11-46
sync_pc Command Sequence ...................................................................................11-47
sync_pc Command Format.......................................................................................11-47
force_TA Command Sequence.................................................................................11-48
force_ta Command....................................................................................................11-48
rcreg Command Sequence........................................................................................11-49
rcreg Command/Result Formats...............................................................................11-49
wcreg Command Sequence.......................................................................................11-52
wcreg Command/Result Formats..............................................................................11-52
rdmreg Command Sequence.....................................................................................11-53
rdmreg bdm Command/Result Formats....................................................................11-53
wdmreg Command Sequence ...................................................................................11-54
wdmreg BDM Command Format.............................................................................11-54
Recommended BDM Connector...............................................................................11-69
CF4e Scan Chains Block Diagram .............................................................................12-3
CF4e and Test Wrapper in SoC..................................................................................12-4
CF4e Core Shared Wrapper Cells...............................................................................12-5
CF4e Core Dedicated Input Wrapper Cell (P Cell)....................................................12-6
Example of Registered CF4eTW Architecture...........................................................12-7
Scans and Flops...........................................................................................................12-8
CF4eTW Input to CF4e Core Scan Stuck-At Vector Example..................................12-9
CF4eTW Input to CF4e Core Scan Delay Vector Example.....................................12-10
CF4e Core to CF4eTW Output Scan Stuck-At Vector Example..............................12-12
CF4e Core to CF4eTW Output Scan Delay Vector Example...................................12-13
CF4eTW to Non-Core Input Scan Stuck-At Vector Example..................................12-14
CF4eTW to Non-Core Delay Scan Vector Example................................................12-15
Non-Core to CF4eTW Input Scan Stuck-At Vector Example..................................12-16
Non-Core to CF4eTW Input Scan Delay Vector Example.......................................12-17
CF4e BIST Hierarchy...............................................................................................12-18
Flow of Characterization Method.............................................................................12-25
March C+ Algorithm ................................................................................................12-26
512 x 32 RAM BIST Clock Cycles..........................................................................12-27
512 x 32 ROM BIST Clock Cycles..........................................................................12-27
PBIST Initialization..................................................................................................12-28
EBIST Timing Diagram for an 8-Kbyte Cache Tag Array.......................................12-29
EBIST Timing Diagram For An 8-Kbyte Cache Data Array...................................12-30
EBIST Timing Diagram For A 2-Kbyte KRAM0 Array..........................................12-31
EBIST Timing Diagram For 2-Kbyte KROM0 Array..............................................12-31
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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參數(shù)描述 |
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| V4FFS5Z18F12C3F12B3F | 制造商:TDK 功能描述:Vega universal input SMPSU,5/2x12V 450W |
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