參數(shù)資料
型號(hào)： V4ECFUM
英文描述： ColdFire CF4e Core User＇s Manual
中文描述： 核心的ColdFire CF4e用戶手冊(cè)
文件頁數(shù)： 21/372頁
文件大小： 4286K
代理商： V4ECFUM
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11-7
Data Cache Data Array Address Connection..............................................................8-21
Data Cache Tag Array Address Connection...............................................................8-21
Data Cache Tag Array Write Data Connection ..........................................................8-21
RAMBARn Field Description....................................................................................8-24
KRAM Size Configuration.........................................................................................8-25
Examples of Typical RAMBAR Settings...................................................................8-27
ROMBAR Field Descriptions.....................................................................................8-30
KROM Size Configuration.........................................................................................8-30
Examples of Typical ROMBAR Settings...................................................................8-32
Valid and Modified Bit Settings.................................................................................8-34
CACR Field Descriptions...........................................................................................8-46
ACRn Field Descriptions............................................................................................8-49
Instruction Cache Line State Transitions....................................................................8-53
Data Cache Line State Transitions..............................................................................8-54
Data Cache Line State Transitions (Previous State Invalid).......................................8-56
Data Cache Line State Transitions (Previous State Valid).........................................8-56
Data Cache Line State Transitions (Previous State Modified)...................................8-57
CF4e Pin Characteristics...............................................................................................9-2
M-Bus Signals...............................................................................................................9-6
Processor Operand Representation.............................................................................9-12
mrdata Requirements for Read Transfers...................................................................9-13
mwdata Bus Requirements for Write Transfers..........................................................9-13
Allowable Line Access Patterns.................................................................................9-14
New ACR and CACR Bits..........................................................................................10-6
Fault Status Encodings................................................................................................10-8
MMU Base Address Register Field Descriptions.....................................................10-11
MMU Memory Map .................................................................................................10-12
MMUCR Field Descriptions.....................................................................................10-13
MMUOR Field Descriptions.....................................................................................10-13
MMUSR Field Descriptions.....................................................................................10-15
MMUAR Field Descriptions.....................................................................................10-15
MMUTR Field Descriptions.....................................................................................10-16
MMUDR Field Descriptions.....................................................................................10-17
Version 4 K-Bus Memory Pipelines.........................................................................10-18
K-Bus Pipeline Cycles..............................................................................................10-18
PLRU State Bits........................................................................................................10-20
Debug Module Signals................................................................................................11-3
PSTDDATA: Sequential Execution of Single-Cycle Instructions.............................11-4
PSTDDATA: Data Operand Captured........................................................................11-5
Processor Status Encoding..........................................................................................11-7
0xE Status Posting......................................................................................................11-9
BDM/Breakpoint Registers.......................................................................................11-11
Rev. A Shared BDM/Breakpoint Hardware.............................................................11-13
F
Freescale Semiconductor, Inc.
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n
.
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PDF描述
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參數(shù)描述
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V4FFS12V40A 制造商:TDK 功能描述:Vega universal input SMPSU,12V 450W
V4FFS24V15A 制造商:TDK 功能描述:Vega universal input SMPSU,24V 450W
V4FFS5V60A,12V12A,12V12A,24V6 制造商:TDK 功能描述:Vega univ input SMPSU,5/2x12/24V 450W
V4FFS5Z18F12C3F12B3F 制造商:TDK 功能描述:Vega universal input SMPSU,5/2x12V 450W
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