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參數(shù)資料
| 型號： | T8110 |
| 英文描述： | Version History |
| 中文描述： | 版本歷史 |
| 文件頁數(shù)： | 10/222頁 |
| 文件大?。?/td> | 2343K |
| 代理商： | T8110 |
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8
Agere Systems Inc.
Data Sheet
May 2001
and Packet Payload Engine
Ambassador T8110 PCI-Based H.100/H.110 Switch
2 Pin Description
2.1 Interface Signals
* Intelis a registered trademark of Intel Corporation.
Motorola
is a registered trademark of Motorola, Inc.
Table 1. Interface Signals
Signal
PCI_AD
PCI_CBE#
PCI_CLK
PCI_DEVSEL#
PCI_FRAME#
PCI_GNT#
PCI_IDSEL
PCI_INTA#
PCI_IRDY#
PCI_LOCK#
PCI_PAR
PCI_PERR#
PCI_REQ#
PCI_RST#
PCI_SERR#
PCI_STOP#
PCI_TRDY#
I/O
I/O
I/O
In
I/O
I/O
In
In
Out
I/O
In
I/O
I/O
Out
In
Out
I/O
I/O
Width
32
4
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
Function
PCI bus address/data.
PCI bus command/byte enable.
PCI bus clock (33 MHz).
PCI bus device select.
PCI bus cycle frame.
PCI bus grant.
PCI bus initialization device select.
PCI bus interrupt.
PCI bus initiator ready.
PCI bus lock.
PCI bus parity.
PCI bus parity error.
PCI bus request.
PCI bus reset.
PCI bus system error.
PCI bus stop.
PCI bus target ready.
Table 2. Minibridge Interface Signals
Signal
MB_A
I/O
I/O
Width
16
Minibridge Function
Address[15:0] out.
Microprocessor Interface Function
Address[15:0] in.
Note:
Special power-on function
for PCI core EEPROM.
MB_A[3] = EE_SK_OUT
MB_A[2] = EE_DI_OUT
MB_A[1] = EE_DO_IN
Data bus I/O.
Read strobe output.
Write strobe output.
Chip select 0 output.
Chip select 1 output.
Chip select 2 output.
Chip select 3 output.
Chip select 4 output.
Chip select 5 output.
Chip select 6 output.
Chip select 7 output.
MB_D
MB_RD
MB_WR
MB_CS0
MB_CS1
MB_CS2
MB_CS3
MB_CS4
MB_CS5
MB_CS6
MB_CS7
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
Out
I/O
16
1
1
1
1
1
1
1
1
1
1
Data bus in/out.
RDn(DSn) in.
WRn(R/Wn) in.
Address[16] in.
Address[17] in.
Address[18] in.
Address[19] in.
CSn in.
Word/byte select in.
RDY(DTACKn) out.
Intel*/Motorola
select in.
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