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參數(shù)資料
| 型號： | T8110 |
| 英文描述： | Version History |
| 中文描述： | 版本歷史 |
| 文件頁數(shù)： | 89/222頁 |
| 文件大小： | 2343K |
| 代理商： | T8110 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁當(dāng)前第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁
Agere Systems Inc.
87
Data Sheet
May 2001
and Packet Payload Engine
Ambassador T8110 PCI-Based H.100/H.110 Switch
7 Clock Architecture
(continued)
Table 65. H-Bus Clock Enable State Description
H-Bus Clock
Enable State
INITIAL
Description
Exit To
Exit Condition
Initial condition, waiting for clock
output control register program-
ming.
T8110 is driving all H-bus clocks
(diagnostic mode).
T8110 is driving both the H-bus A
and B clocks (diagnostic mode).
T8110 is driving only the
H-bus C clocks.
T8110 clock output control registers
are programmed to drive A clocks
and C clocks (T8110 is an A clock
master), or T8110 was supplying a
backup A clock and has been pro-
moted to A clock master.
T8110 clock output control registers
are programmed to drive A clocks
only (T8110 is a B clock slave, and
supplies a backup A clock).
Any of the
other states
User update of the clock output control regis-
ter (0x00220, master output enables).
DIAG_ABC
INITIAL
User update of the clock output control regis-
ter (0x00220, master output enables).
User update of the clock output control regis-
ter (0x00220, master output enables).
User update of the clock output control regis-
ter (0x00220, master output enables).
A clock error on CT_C8_A or /CT_FRAME_A
is detected; disable clock outputs.
User update of the clock output control regis-
ter (0x00220, master output enables).
DIAG_AB
INITIAL
C_ONLY
INITIAL
A_MASTER
A_ERROR
INITIAL
A_ONLY
A_MASTER A clock error on CT_C8_B or /CT_FRAME_B
is detected; promote to A clock master.
A_ERROR
A clock error on CT_C8_A or /CT_FRAME_A
is detected; disable clock outputs.
INITIAL
User update of the clock output control regis-
ter (0x00220, master output enables).
INITIAL
User update of the clock output control regis-
ter (0x00220, master output enables).
A_ERROR
T8110 has detected a clock error
while driving the A clocks, and has
stopped driving any H bus clocks.
T8110 clock output control registers
are programmed to drive B clocks
and C clocks (T8110 is a B clock
master),
or
T8110 was supplying a
backup B clock and has been pro-
moted to B clock master.
T8110 clock output control registers
are programmed to drive B clocks
only (T8110 is an A clock slave, and
supplies a backup B clock).
B_MASTER
B_ERROR
A clock error on CT_C8_B or /CT_FRAME_B
is detected; disable clock outputs.
User update of the clock output control regis-
ter (0x00220, master output enables).
INITIAL
B_ONLY
B_MASTER A clock error on CT_C8_A or /CT_FRAME_A
is detected; promote to B clock master.
B_ERROR
A clock error on CT_C8_B or /CT_FRAME_B
is detected; disable clock outputs.
INITIAL
User update of the clock output control regis-
ter (0x00220, master output enables).
INITIAL
User update of the clock output control regis-
ter (0x00220, master output enables).
B_ERROR
T8110 has detected a clock error
while driving the B clocks, and has
stopped driving any H bus clocks.
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