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參數(shù)資料
| 型號(hào)： | T8110 |
| 英文描述： | Version History |
| 中文描述： | 版本歷史 |
| 文件頁(yè)數(shù)： | 41/222頁(yè) |
| 文件大?。?/td> | 2343K |
| 代理商： | T8110 |
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Agere Systems Inc.
39
Data Sheet
May 2001
and Packet Payload Engine
Ambassador T8110 PCI-Based H.100/H.110 Switch
5 Microprocessor Interface
(continued)
5.3 Access Via the Microprocessor Bus
The T8110 microprocessor bus interface allows access to three internal regions: registers, connection memory,
and data memory. The virtual channel memory can be made accessible via a special diagnostic mode setting. All
microprocessor bus asynchronous strobes are synchronized to the T8110’s internal 65.536 MHz clock domain.
There are 20 address bits provided to address the internal regions and these are defined in Table 15.
Table 15. T8110 Memory Mapping to Microprocessor Space
Region
Subregion
Range (hex)
Registers
Reserved
0x00000—0x000FF
0x00100—0x001FF
0x00200—0x002FF
0x00300—0x003FF
0x00400—0x004FF
0x00500—0x005FF
0x00600—0x006FF
0x00700—0x007FF
0x00800—0x0FFFF
0x10000—0x1FFFF
0x20000—0x2FFFF
0x30000—0x3FFFF
0x40000—0x4FFFF
0x50000—0xFFFFF
Operating control and status
Clocks
Rate control
Frame group
General-purpose I/O
Interrupt control
Reserved
Reserved
—
—
—
—
—
Virtual channel memory (diagnostic only)
Data memory
Reserved
Connection memory
Reserved
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