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參數(shù)資料
| 型號： | T8110 |
| 英文描述： | Version History |
| 中文描述： | 版本歷史 |
| 文件頁數(shù)： | 69/222頁 |
| 文件大?。?/td> | 2343K |
| 代理商： | T8110 |
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Agere Systems Inc.
67
Data Sheet
May 2001
and Packet Payload Engine
Ambassador T8110 PCI-Based H.100/H.110 Switch
7 Clock Architecture
(continued)
7.1.8 LREF Input Select Registers
The LREF input select register is used in conjunction with the main input selector (0x00200) and provides the
selection control among the eight LREF inputs when the main selection is set for either individual or paired LREFs.
The LREF inversion select register allows programmable inversion for each LREF input. Please refer to Figure 19
on page 62 for further details.
Table 51. LREF Input/Inversion Select Registers
Byte
Address
Name
Bit(s) Mnemonic
Value
Function
0x00208 LREF Input
Select
7:0
LRISR
0000 0000
0000 0001
0000 0010
0000 0100
0000 1000
0001 0000
0010 0000
0100 0000
1000 0000
0001 0001
0010 0010
0100 0100
1000 1000
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Select LREF0 (default).
Select LREF0.
Select LREF1.
Select LREF2.
Select LREF3.
Select LREF4.
Select LREF5.
Select LREF6.
Select LREF7.
Select paired, clock = LREF0, frame = LREF4.
Select paired, clock = LREF1, frame = LREF5.
Select paired, clock = LREF2, frame = LREF6.
Select paired, clock = LREF3, frame = LREF7.
Don’t invert LREF7 (default).
Invert LREF7.
Don’t invert LREF6 (default).
Invert LREF6.
Don’t invert LREF5 (default).
Invert LREF5.
Don’t invert LREF4 (default).
Invert LREF4.
Don’t invert LREF3 (default).
Invert LREF3.
Don’t invert LREF2 (default).
Invert LREF2.
Don’t invert LREF1 (default).
Invert LREF1.
Don’t invert LREF0 (default).
Invert LREF0.
0x0020C LREF Inversion
Select
7
IR7SB
6
IR6SB
5
IR5SB
4
IR4SB
3
IR3SB
2
IR2SB
1
IR1SB
0
IR0SB
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