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參數(shù)資料
| 型號： | T8110 |
| 英文描述： | Version History |
| 中文描述： | 版本歷史 |
| 文件頁數(shù)： | 141/222頁 |
| 文件大小： | 2343K |
| 代理商： | T8110 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁當(dāng)前第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁
Agere Systems Inc.
139
Data Sheet
May 2001
and Packet Payload Engine
Ambassador T8110 PCI-Based H.100/H.110 Switch
14
Connection Control—Standard and Virtual Channel
(continued)
5-9627 (F)
Figure 40. PCI Programming
—Read Virtual Channel Static Command
5-9630 (F)
Figure 41. PCI Programming—Read Virtual Channel Scratchpad Command
14.1.2 Microprocessor Interface
When the T8110 microprocessor interface is the selected bus interface, only standard telephony switching is
allowed (no virtual channel switching). A standard telephony connection is made by writing to a location in the con-
nection memory. There is a mode in which the virtual channel memory may be accessed via the microprocessor
interface, included for diagnostic purposes only.
14.1.2.1 Microprocessor Connection Memory Programming
Because the microprocessor interface only allows word or byte accesses, multiple write accesses must occur. The
microprocessor connection memory access mimics the 32-bit PCI access by using a combination of the lower two
address bits [1:0] and holding registers. For byte access, there are a total of three byte-wide holding registers. For
word access, there is one word-wide holding register. The user must load the holding registers with the proper
information first, and then write to the upper byte (or upper word) to actually move data into the connection mem-
ory; refer to Table 110.
31:20
BASE ADDRESS
19:16
0001
15:8
VC IDENTIFIER ADDRESS
7
6:4
000
15:12
0000
1:0
00
RETURNS THE RELATIVE OFFSET
OF DEEPEST BYTE (MAX = 255)
VC PAGE ADDRESS
0 = VC EVEN PAGE
1 = VC ODD PAGE
VCPA
ADDRESS PHASE,
VIRTUAL CHANNEL
MEMORY READ
STATIC COMMAND
DATA PHASE,
VIRTUAL CHANNEL
MEMORY READ
STATIC COMMAND
31:24
00000000
23:18 STATIC
DEPTH (STD)
17:16
11
11:2
STATIC BASE ADDRESS (SBA)
3
0
2:0
000
STATIC/SCRATCHPAD SELECT
0 = STATIC ENTRIES
1 = SCRATCHPAD
SSS
31:20
BASE ADDRESS
19:16
0001
15:8
VC IDENTIFIER ADDRESS
7
6:4
000
15:8 SCRATCHPAD
CURRENT OFFSET (SPCO)
7:0
MEMORY POINTER, CURRENT
OFFSET WITHIN CHANNEL BUFFER.
VC PAGE ADDRESS
0 = VC EVEN PAGE
1 = VC ODD PAGE
VCPA
ADDRESS PHASE,
VIRTUAL CHANNEL
MEMORY READ
SCRATCHPAD
COMMAND
DATA PHASE,
VIRTUAL CHANNEL
MEMORY READ
SCRATCHPAD
COMMAND
00000000
31:24 SCRATCHPAD
CURRENT DEPTH (SPCD)
23:16
00000000
3
1
2:0
000
STATIC/SCRATCHPAD SELECT
0 = STATIC ENTRIES
1 = SCRATCHPAD
SSS
VALUE OF THE COUNTER WHICH
TRACKS THE NUMBER OF BYTES
USED IN THE BUFFER.
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