參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 107/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
107
Agere Systems Inc.
8 TMUX Registers
(continued)
Table 118. TMUX_THS_POH[1—3]_CTL, Transmit High-Speed Control Parameters (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
0
0x40036
15:9
8
RSVD
Reserved.
TMUX_THSPREIINH1
Transmit Path REI Inhibit for Port 1.
Control bit, when set to
a logic 1, disables hardware insertion of path REI (B3 errors)
in the outgoing STM-1 (AU-4) frame G1 byte; a logic 0
enables hardware insertion of path REI. Only port 1 control is
valid in AU-4 mode.
TMUX_TPOHTHRU1
Transmit High-Speed Path Overhead Insertion from Low-
Speed Input (Telecom Bus).
Control bit, when set to a logic
1, causes all path overhead bytes, and H1, H2, and H3, to be
passed through from the low-speed telecom bus to the high-
speed output signal. Only port 1 control is valid in AU-4 mode.
TMUX_THSN1INS1
Transmit N1 Insert (Control) for Port 1.
Control bit, when
set to a logic 1, inserts the value in TMUX_TN1INS1[7:0]
(
Table 124 on page 112
) into the outgoing N1 byte in the
STS-3/STM-1 (AU-4) frame; a logic 0 allows insertion from the
TPOAC channel or a default value. Only port 1 control is valid
in AU-4 mode.
TMUX_THSK3INS1
Transmit K3 Insert (Control) for Port 1.
Control bit, when
set to a logic 1, inserts the value in TMUX_TK3INS1[7:0]
(
Table 124 on page 112
) into the outgoing K3 byte in the
STS-3/STM-1 (AU-4) frame; a logic 0 allows insertion from the
TPOAC channel or a default value. Only port 1 control is valid
in AU-4 mode.
TMUX_THSF3INS1
Transmit F3 Insert (Control) for Port 1.
Control bit, when
set to a logic 1, inserts the value in TMUX_TF3INS1[7:0]
(
Table 124 on page 112
) into the outgoing F3 byte in the STS-
3/STM-1 (AU-4) frame; a logic 0 allows insertion from the
TPOAC channel or a default value. Only port 1 control is valid
in AU-4 mode.
TMUX_THSF2INS1
Transmit F2 Insert (Control) for Port 1.
Control bit, when
set to a logic 1, inserts the value in TMUX_TF2INS1[7:0]
(
Table 124 on page 112
) into the outgoing F2 byte in the STS-
3/STM-1 (AU-4) frame; a logic 0 allows insertion from the
TPOAC channel or a default value. Only port 1 control is valid
in AU-4 mode.
TMUX_THSRDIPINS1
Transmit Path RDI Insert (Control) for Port 1.
Control bit,
when set to a logic 1, inserts the value in
TMUX_TRDIPINS1[2:0]
(
Table 124 on page 112
) into the out-
going G1[3:1] bits in the STS-3/STM-1 (AU-4) frame; a logic 0
allows insertion from the TPOAC channel or a default value.
Only port 1 control is valid in AU-4 mode.
7
0
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0
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0
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0
3
0
2
0
相關PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關代理商/技術參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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