參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 204/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
204
Agere Systems Inc.
11 M13/M23 MUX/DeMUX Registers
(continued)
Table 229. M13_DELTA4, Delta (RO)
Address
Bit
Name
Function
Reset
Default
0x00
0
0x10007
15:8
7
RSVD
Reserved.
This bit is set when the M13 completes transmission of a
sequence of FEAC control code. It can be programmed to
be either clear on read (COR) or clear on write (COW), and
it is not set to 1 again until the event reoccurs.
This bit is set when the M13 completes transmission of a
data-link frame. It can be programmed to be either clear on
read (COR) or clear on write (COW), and it is not set to 1
again until the event reoccurs.
This bit is set when the device completes transmission of
M13_TDL_1DATA63[7:0] (
Table 311 on page 230
) (the
last byte of buffer 1). It can be programmed to be either
clear on read (COR) or clear on write (COW), and it is not
set to 1 again until the event reoccurs.
This bit is set when the device completes transmission of
M13_TDL_0DATA63[7:0] (
Table 310 on page 230
) (the
last byte of buffer 0). It can be programmed to be either
clear on read (COR) or clear on write (COW), and it is not
set to 1 again until the event reoccurs.
This delta bit is set if M13_RDL_FIFO_AF (
Table 237 on
page 209
) changes state. It can be programmed to be
either clear on read (COR) or clear on write (COW), and it
is not set to 1 again until another state transition occurs.
This bit indicates that a new data-link frame closing flag or
an abort Byte Has Been Received. It can be programmed
to be either clear on read (COR) or clear on write (COW),
and it is not set to 1 again until the event reoccurs.
M13_RFEAC_ALM_INT This bit indicates that a new DS3 FEAC alarm codeword
has been received. The new codeword is available in reg-
ister M13_RFEAC_CODE_R (
Table 264 on page 216
). For
loopback codewords, the appropriate
M13_DS1_FEAC_LB_DETx (
Table 263 on page 216
) and
M13_DS3_FLB_DET (
Table 263 on page 216
) bits in reg-
isters 0x2F through 0x32 will be set or cleared. It can be
programmed to be either clear on read (COR) or clear on
write (COW), and it is not set to 1 again until the event
reoccurs.
M13_RFEAC_LB_INT
This bit indicates that a new DS3 FEAC loopback code-
word has been received. The new codeword is available in
register M13_RFEAC_CODE_R. For loopback codewords,
the appropriate M13_DS1_FEAC_LB_DETx and
M13_DS3_FLB_DET bits will be set or cleared. It can be
programmed to be either clear on read (COR) or clear on
write (COW), and it is not set to 1 again until the event
reoccurs.
M13_TFEAC_DONE
6
M13_TDL_DONE
0
5
M13_TDL_BUF1_INT
0
4
M13_TDL_BUF0_INT
0
3
M13_RDL_FIFO_AFD
0
2
M13_RDL_FRM_INT
0
1
0
0
0
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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