參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類(lèi)： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁(yè)數(shù)： 543/784頁(yè)
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
543
Agere Systems Inc.
21 28-Channel Framer Block Functional Description
(continued)
21.26.19 Drive to 3-State and 3-State to Drive Timing
The minimum number of stuff time-slots is 3 (in the E1 mode). This allows enough time to switch the bus between
devices. The device on the bus can drive the bus high for one extra clock cycle to ensure a fast rise time. The
device then 3-states while the bus is pulled high, using a pull-up resistor. Optionally, the next device starts driving
early for one clock cycle to ensure that there is minimal delay between the clock and data outputs (the turn-on
delay of the buffer is eliminated by turning on the buffer one clock cycle early). The timing for the case of three stuff
time-slots is shown in the
Figure 77
. (In the receive direction from the switch, it is assumed the stuff time-slots are
driven to 1.)
5-8992(F)
Figure 77. Parallel Bus System Interface Turnaround Timing
See
Section 5.6, Parallel System Bus Timing, on page 49
for PSB receive and transmit interface and clock timing
parameter specifications.
21.27 Serial Multiplex Interface
The network serial multiplexed interface (NSMI) provides a no-slip capability for transfer of multiple framed DS1s
and/or E1s from one device to another using a very narrow interface. A no-slip interface is widely used in datacom
and IMA applications. There are two NSMI interface modes of operation requiring either six or eight signals to be
used.
Mode 1 uses six primary signals. The six primary signals are composed of three transmit and three receive signals.
The transmit signals are LINETXCLK29 (R24), LINETXDATA29 (T23), and LINETXSYNC29 (R26). The receive
signals are LINERXCLK29 (B13), LINERXDATA29 (D13), and LINERXSYNC29 (A13). Each group of three signals
provide clock, data, and control information.
The data and link number specified by the LINETXDATA29 and LINETXSYNC29 will be received in the same order
by the receive side of the Supermapper after traversing the switch side of the system.
DEV 1 MAY DRIVE
HIGH ONE CLOCK
CYCLE EARLY
DEV 0, LINK 0-N
PULLED HIGH
USING A PULL-UP
DEV 0 DRIVES
HIGH FOR ONE
EXTRA CLOCK
CYCLE
DEV 1, LINK 0-N
R
R
R
MINIMUM OF 3 STUFF TIMESLOTS
SYS DATA[I]
SYS CLK
DEV 0 ENA
DRIVE
HIGH-IMPEDANCE
DEV 1 ENA
HIGH-IMPEDANCE
DRIVE
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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