參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 547/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
547
Agere Systems Inc.
21 28-Channel Framer Block Functional Description
(continued)
8-Pin Mode.
As in the 6-pin mode, the Supermapper sends data and link information through the transmit signals.
However, in the 8-pin mode, it requests data through the extra transmit signals. The data is then expected to be
sent back for the same link number and time slot on the Supermapper’s receive signals. As in the 6-pin mode, the
only requirement is that it receives data at a constant time interval.
21.28 Superframer Host Interface
21.28.1 Superframer Register Addressing
Table 620 summarizes the current number of global and per-link/channel registers for each block.
Table 620. Current Number of Global and Per-Link/Channel Registers for Each Block
All of the block global registers will be combined with the top global register. Each block will receive a global select
and a per-link/per-channel select.
The block addressing is summarized below. An extra bit is used for future growth of global and link/channel regis-
ters.
Table 621 on page 548
describes the addressing scheme. Bit 14 is used to indicate whether a link or HDLC chan-
nel is selected (0 selects link and global registers; 1 selects HDLC registers). When an HDLC channel is to be
addressed, bits B13—B8 indicate the HDLC channel numbers 0—63 (000000—111111), bit B7 indicates the trans-
mit or receive paths, and bits B3—B0 indicate the register number. When a link is selected, bits B13—B9 indicate
the link numbers 1—28 (00001—11100), and bit B8 indicates the transmit and receive paths for the link.
Bits B7—B0 indicate the block and register number, as shown in the framer addressing map for the global and per-
link/channel registers of the Superframer,
Table 621
. Global registers are selected by setting B14—B9 = 000000,
selecting a block using bits B7—B4, and selecting a register using bits B3—B0.
Block
TOP
AR
RXP FF
TXP FF
RXP PM
TXP PM
RXP SYS
TXP SYS
RXP HDLC
TXP HDLC
RXP DL
TXP DL
RXP SIG
TXP SIG
RXP LC
TXP LC
Global
1
0
0
0
15
15
5
1
6
6
0
0
1
1
0
0
Per-Link/Per-Channel
0/0
2/0
2/0
2/0
19/0
19/0
3/0
2/0
0/8
0/8
9/0
9/0
41/0
36/0
1/0
1/0
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PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
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