參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 251/784頁
文件大小： 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
251
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 323. FRM_PMGR1, Performance Monitor Global Register 1 (COR)
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Table 324. FRM_PMGR2, Performance Monitor Global Register 2 (COR)
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Address
*
Bit
Name
Function
Reset
Default
0x0000
0
0x80P30
15:2
1
RSVD
Reserved.
Must write to 0.
Test-Pattern Detect.
A 1 indicates the pattern detector has
locked onto the pattern specified by the FRM_PTRN_SEL[3:0]
(
Table 336 on page 256
) configuration bits. There is only one
test-pattern detector. See O.151, Section 2. Both framed and
unframed test-pattern generation/detection are supported.
FRM_PTRNBER
Test-Pattern Bit Error.
A 1 indicates the receive framer pattern
detector has found one or more single-bit errors in the pattern on
to which it is currently locked. There is only one test-pattern BER
counter for all links.
FRM_DETECT
0
0
Address
*
Bit
Name
Function
Reset
Default
0
0x80P31
15:0
FRM_TPERR_CT[15:0]
Test Pattern Error Count Register.
This register con-
tains the 16-bit count of test-pattern errors.
Table 325. FRM_PMGR3, Performance Monitor Global Register 3 (R/W)
Address
*
Bit
Name
Function
Reset
Default
00
001
001
0x80P32
15:14
13:11
10:8
RSVD
Reserved.
Must write to 0.
CEPT Mode RAI Activation Count
.
CEPT Mode RAI Deactivation Count
.
RAC and RDC
can be set to meet various standards.
F
S
Frame Bit Error Enable.
Allows a signaling frame (F
S
)
bit error to set the FBE status bit, FRM_FBE (
Table 398 on
page 287
).
In DDS, a 0 means do not count TS24 framing and F
S
as
FBEs; a 1 means count TS24 framing and Fs as FBEs.
0 = FS bit errors disabled.
1 = FS bit errors enabled.
CEPT Multiframe Reframe Enable.
0 = CEPT CRC-4 multiframe reframe disabled.
1 = CEPT CRC-4 multiframe reframe enabled. A research
for multiframe alignment is initiated upon a loss of
CEPT CRC-4 multiframe alignment.
CRC Reframe Enable.
0 = CRC errors do not cause a reframe or LOF condition.
1 = the receive performance monitor will force a reframe
and LOF condition on excessive CRC errors.
FRM_RAC[2:0]
FRM_RDC[2:0]
7
FRM_FSFBEEN
0
6
FRM_CMFRFEN
0
5
FRM_CRCRFEN
1
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
FRM_RACFRM_RDC Standard.
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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