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參數(shù)資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態(tài)抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 431/784頁 |
| 文件大?。?/td> | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
431
Agere Systems Inc.
19 VT/TU Mapper Functional Description
Table of Contents
Contents
Page
19 VT/TU Mapper Functional Description ............................................................................................................431
19.1 VT/TU Mapper Introduction......................................................................................................................433
19.2 VT/TU Mapper Features...........................................................................................................................433
19.3 VT/TU Mapper Functional Block Diagram................................................................................................434
19.4 VT/TU Mappings ......................................................................................................................................436
19.5 VT/TU Locations.......................................................................................................................................437
19.6 VT/TU Mapper Receive Path Description ................................................................................................438
19.7 VT Demultiplexer (VTDEMUX).................................................................................................................438
19.8 VT Pointer Interpreter (VTPI) ...................................................................................................................438
19.9 VT Termination (VTTERM).......................................................................................................................441
19.9.1 V5 Termination .............................................................................................................................. 441
19.9.2 Z6/N2 Termination ........................................................................................................................ 442
19.9.3 Z7/K4 Termination ........................................................................................................................ 443
19.9.4 Payload Termination ..................................................................................................................... 443
19.10 Output Signal Selection (OUTSEL)........................................................................................................444
19.11 J2 Byte Monitor and Termination (J2MON)............................................................................................444
19.12 Receive Signaling (RX_VTSIG) .............................................................................................................445
19.13 Receive Lower-Order Path Overhead (RX_LOPOH).............................................................................446
19.14 VT/TU Mapper Transmit Path Requirements.........................................................................................447
19.14.1 Input Selector (INSEL) ................................................................................................................ 447
19.14.2 Transmit Elastic Store (TES) ...................................................................................................... 448
19.14.3 Virtual Tributary Generator (VTGEN) .......................................................................................... 449
19.14.4 Pointer Generation ...................................................................................................................... 449
19.14.5 VT Multiplexer (VTMUX) ............................................................................................................. 457
19.14.6 Transmit Signaling (TX_VTSIG) ................................................................................................. 457
19.14.7 Transmit Lower Path Overhead (TX_LOPOH) ........................................................................... 457
19.15 VT Mapper System Interface Timing......................................................................................................458
19.15.1 VT Mapper DS1/E1 Receive Interface (to System Interface) ..................................................... 458
19.15.2 VT Mapper DS1/E1 Transmit Interface (from System Interface) ................................................ 459
19.16 VT Mapper Lower-Order Path Overhead Interface Timing ....................................................................459
19.16.1 VT Mapper Receive Path Overhead Interface Description ......................................................... 459
19.16.2 VT Mapper Transmit Path Overhead Interface Description ........................................................ 460
Figures
Page
Figure 39. VT Mapper Interface Diagram..............................................................................................................434
Figure 40. VT Mapper Functional Block Diagram..................................................................................................435
Figure 41. Pointer Interpretation State Diagram....................................................................................................439
Figure 42. DS1 Mode Gapped Clocking Scheme..................................................................................................458
Figure 43. E1 Mode Gapped Clocking Scheme ....................................................................................................458
Figure 44. DS1 Interface .......................................................................................................................................458
Figure 45. E1 Interface..........................................................................................................................................459
Figure 46. VT Mapper Receive Path Overhead Serial Access Channel...............................................................459
Figure 47. VT Mapper Transmit Path Overhead Serial Access Channel..............................................................460
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PDF描述 |
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