參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 409/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
409
Agere Systems Inc.
18 SPE Mapper Functional Description
(continued)
The TUG-3 has a structure of 9 rows by 86 columns: one column of null pointer indication (NPI) plus fixed stuffing
bytes, one column of fixed stuffing, and the other 84 columns are seven TUG-2s evenly distributed within the
TUG-3 payload.
18.6 DS3 to AU-3/STS-1 SPE Mapping (Used in
Telcordia
/
ANSI
Standards-Based Systems)
DS3 is an asynchronous signal with a rate of 44.736 Mbits/s. This payload with other information bits (total
3.648 Mbits/s) is used to form the container C-3 (48.384 Mbits/s) which occupies 84 columns of an STS-1 frame.
One column of path overhead bytes is added to the C-3 container to make a VC-3. Finally, two columns of fixed
stuffing (column numbers 30 and 59) are added to VC-3 to form an STS-1 SPE (87 columns).
Stuffing (S bits) is used to rate adapt the DS3 payload to the SPE. Nine stuffing S bits are included in the C-3 con-
tainer. When no stuffing is used, the STS-1 SPE can accommodate a rate of 44.712 Mbits/s. When all 9 stuffing
S bits are used, the STS-1 SPE can accommodate 44.784 Mbits/s. Since the DS3 coming from the M13 has a
nominal rate of 44.736 Mbits/s, stuffing is used for every third row of an STS-1 frame; or, in other words, three S
bits per 125 μs are used for stuffing to achieve the DS3 rate.
18.7 DS3 to TUG-3 Mapping (Used in ITU/ETSI Standards-Based Systems)
DS3 is an asynchronous signal with a rate of 44.736 Mbits/s. This payload with other information bits (total
3.648 Mbits/s) is used to form the container C-3 (48.384 Mbits/s), which occupies 84 columns of an STM-1 frame.
One column of path overhead bytes are added to the C-3 container to make a VC-3 (85 columns). Now a TUG-3
signal consists of 86 columns by 9 rows; therefore, 3 bytes of TU-3 pointer (H1, H2, and H3 bytes) are placed on
rows 1 through 3 of the newly added column and fixed stuffing bits are placed on the remaining rows. Thus, a
TUG-3 frame of 9 rows by 86 columns is formed. Three TUG-3s are byte interleavingly multiplexed by the TMUX to
form an STM-1 signal.
Stuffing (S bits) is used to rate adapt the DS3 payload to the TUG-3. Nine stuffing S bits are included in the C-3
container. When no stuffing is used, the TUG-3 payload can accommodate a rate of 44.712 Mbits/s. When all 9
stuffing S bits are used, the TUG-3 payload can accommodate 44.784 Mbits/s. Since the DS3 coming from the
M13 has a nominal rate of 44.736 Mbits/s, stuffing is used for every third row of a TUG-3 frame; or, in other words,
three S bits per 125 μs are used for stuffing to achieve the DS3 rate.
18.8 SPE Mapper Basic Configuration
SPE mapper configuration programming is provided through registers SPE_MAP_CTL1—SPE_MAP_CTL3
(
Table 163 on page 143
).
When mapping to an STS-3/STM-1 rate, the SPE mapper requires configuration to select one of the three time
slots on the telecom bus that interfaces the TMUX. The register bits for selection are SPE_TSTS3TMSLOT[1:0]
and SPE_RSTS3TMSLOT[1:0] (
Table 163
).
Selection of AU-3/STS-1 or TUG-3 mapping is provided through bits SPE_T_AU3_TUG3 and SPE_R_AU3_TUG3
(
Table 163
).
TUG-2 (virtual tributary) or DS3 data is selected with bits SPE_T_AU3_TUG3 and SPE_R_AU3_TUG3.
18.9 DS3 Configuration
The SPE mapper is configured to select the source and destination of the DS3 signals. The configuration is deter-
mined with register bits SPE_TDS3SRCTYP[1:0] and SPE_RDS3OUTTYP[1:0] (
Table 163
). DS3 source/destina-
tion may be selected as loopback, external device pins, or M13.
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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