參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 349/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
349
Agere Systems Inc.
15 Test-Pattern Generation/Detection Registers
(continued)
Table 512. TPG_VAL_CRCE, Register (RO)
Table 513. TPG_BER_INSRT, Register (R/W)
Table 514. TPG_FER_INSRT, Register (R/W)
Table 515. TPG_CRCE_INSRT, Register (R/W)
Address
Bit
Name
Function
Reset
Default
0x0000
0
0x60024
15:3
2
RSVD
Reserved.
TPG_CRCEINS2 This bit is set when the user desires to inject a single CRC error
into the E1 test signal (via 0 to 1 transition).
RSVD
Reserved.
TPG_CRCEINS0 This bit is set when the user desires to inject a single CRC error
Into the DS1 test signal (via 0 to 1 transition).
1
0
0
0
Address
Bit
Name
Function
Reset
Default
0
0x60028
15
TPG_BER_EN
This bit, when set, allows automatic bit error insertion by the
microprocessor.
Reserved.
This bit is set when the user desires to inject a single bit error into
the DS3 test signal via SMPR_BER_INSRT (
Table 75 on
page 68
).
This bit is set when the user desires to inject a single bit error into
the DS2 test signal via SMPR_BER_INSRT.
Reserved.
This bit is set when the user desires to inject a single bit error into
the E1 test signal via SMPR_BER_INSRT.
Reserved.
This bit is set when the user desires to inject a single bit error into
the DS1 test signal via SMPR_BER_INSRT.
14:6
5
RSVD
0x000
0
TPG_BERINS5
4
TPG_BERINS4
0
3
2
RSVD
0
0
TPG_BERINS2
1
0
RSVD
0
0
TPG_BERINS0
Address
Bit
Name
Function
Reset
Default
0x0000
0
0x60029
15:3
2
RSVD
Reserved.
This bit injects a single framing error into the E1 test signal (via 0
to 1 transition).
Reserved.
This bit injects a single framing error into the DS1 test signal (via
0 to 1 transition).
TPG_FERINS2
1
0
RSVD
0
0
TPG_FERINS0
Address
Bit
Name
Function
Reset
Default
0x0000
0
0x6002A
15:3
2
RSVD
Reserved.
TPG_CRC4EINS2 This bit is set when the user desires to inject a single
CRC-4 error into the E1 test signal (via 0 to 1 transition).
RSVD
Reserved.
TPG_CRC6EINS0 This bit is set when the user desires to inject a single
CRC-6 error into the DS1 test signal (via 0 to 1 transition).
1
0
0
0
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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