參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 118/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
118
Agere Systems Inc.
8 TMUX Registers
(continued)
Table 128. TMUX_RPOAC_CTL, Receive/Transmit TOAC/POAC Control Parameters (R/W)
(continued)
Table 129. TMUX_TFRAMEOFFSET, Transmit High-Speed Offset Control Parameters (R/W)
)
Table 130. TMUX_SD_CTL[1
—
6], B1/B2 Signal Degrade Set/Clear Control Registers (R/W)
Address
Bit
Name
Function
Reset
Default
0
0x4004B
2
TMUX_TPOAC_C2
Transmit POAC C2 Byte Control.
When 1, causes
the incoming POAC C2 value to be inserted into the
C2 byte of the selected TPOAC STS-1 if the corre-
sponding TMUX_THSC2INS (
Table 118 on page 107
)
control bit is desasserted. If the C2 is not inserted from
register control or from the transmit POAC channel,
then its value depends on SMPR_OH_DEFLT.
Transmit POAC J1 Byte Control.
Control bit, when
set to a logic 1, causes the incoming POAC J1 value to
be inserted into the J1 byte of the selected TPOAC
STS-1 if the corresponding TMUX_THSJ1INS
(
Table 118 on page 107
) control bit is desasserted. If
the J1 is not inserted from register control or from the
transmit POAC channel, then its value depends on
SMPR_OH_DEFLT.
1
TMUX_TPOAC_J1
0
0
TMUX_TPOAC_OEPMON
Transmit TOAC Odd or Even Parity Monitor.
Control
bit, when set to a logic 1, forces the input TOAC parity
checker to check for odd parity; otherwise, even parity
is checked on the transmit TOAC channel.
0
Address
Bit
Name
Function
Reset
Default
000
0x4004D
15:13
TMUX_TLBITCNT[2:0]
Transmit Load Bit Count.
Allows the output
STS-3/STM-1 (AU-4) frame to have any relationship to
the input frame sync pulse (THSSJ0J1V1I).
Transmit Load STS-1 Count.
Same as above.
Transmit Load Column Count.
Same as above.
Transmit Load Row Count
. Same as above.
12:11
10:4
3:0
TMUX_TLSTSCNT[1:0]
TMUX_TLCOLCNT[6:0]
TMUX_TLROWCNT[3:0]
00
0000000
0000
Address
Bit
Name
Function
Reset
Default
0x00000
0x4004E
0x4004F
0x4004F
15:0
2:0
15
14:7
TMUX_SDNSSET[18:3]
TMUX_SDNSSET[2:0]
RSVD
TMUX_SDMSET[7:0]
Signal Degrade Ns Set.
Number of frames in a
monitoring block for signal degrade (SD).
Reserved.
Signal Degrade M Set.
Threshold of the number of bad
monitoring blocks in an observation interval. If the
number of bad blocks is above this threshold, then SD
is set.
Signal Degrade L Set.
Error threshold for determining
if a monitoring block is bad.
Signal Degrade B Set.
Number of monitoring blocks.
Signal Degrade Ns Clear.
Number of frames in a
monitoring block for SD.
0x00
6:3
TMUX_SDLSET[3:0]
0x0
0x40050
0x40051
0x40052
15:0
15:0
2:0
TMUX_SDBSET[15:0]
TMUX_SDNSCLEAR[18:3]
TMUX_SDNSCLEAR[2:0]
0x0000
0x00000
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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