參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 258/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
258
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 341. FRM_HGR3, Transmit HDLC Global Register 3 (R/W)
Table 342. FRM_HGR4, Transmit HDLC Global Register 4 (R/W)
Table 343. FRM_HGR5, Transmit HDLC Global Register 5 (R/W)
Table 344. FRM_HGR6, Transmit HDLC Global Register 6 (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x80142
15:8
7:0
RSVD
Reserved.
Must write to 0.
FRM_TXICHAR0[7:0]
Transparent Mode Transmit Idle Char 0.
These bits are
used in transparent mode. They represent the first 8-bit pat-
tern the transmitter should send when there is no data
available in the FIFO. One of the four patterns can be
selected on a per-channel basis with the
FRM_HXPIDLE[1:0] (
Table 448 on page 311
) parameter.
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x80143
15:8
7:0
RSVD
Reserved.
Must write to 0.
FRM_TXICHAR1[7:0]
Transparent Mode Transmit Idle Char 1.
These bits are
used in transparent mode. They represent the second 8-bit
pattern the transmitter will send when there is no data avail-
able in the FIFO. One of the four patterns can be selected
on a per-channel basis with the FRM_HXPIDLE[1:0]
(
Table 448 on page 311
) parameter.
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x80144
15:8
7:0
RSVD
Reserved.
Must write to 0.
FRM_TXICHAR2[7:0]
Transparent Mode Transmit Idle Char 2.
These bits are
used in transparent mode. They represent the third 8-bit
pattern the transmitter will send when there is no data avail-
able in the FIFO. One of the four patterns can be selected
on a per-channel basis with the FRM_HXPIDLE[1:0]
(
Table 447 on page 310
) parameter.
Address
Bit
Name
Function
Reset
Default
0x00
0x00
0x80145
15:8
7:0
RSVD
Reserved.
Must write to 0.
FRM_TXICHAR3[7:0]
Transparent Mode Transmit Idle Char 3.
These bits are
used in transparent mode. They represent the fourth 8-bit
pattern the transmitter will send when there is no data avail-
able in the FIFO. One of the four patterns can be selected
on a per-channel basis with the FRM_HXPIDLE[1:0]
(
Table 447 on page 310
) parameter.
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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