參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 215/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
215
Agere Systems Inc.
11 M13/M23 MUX/DeMUX Registers
(continued)
Table 260. M13_DS1_AIS_DET_R[1—4], DS1 Alarm Indication Signal Detect Status Registers (RO)
Table 261. M13_DS1_LB_DET_R[1—4], DS1 Loopback Detect Status Registers (RO)
Table 262. M13_DS1_FEAC_LB_DETD_R[1—4], DS1 Far-End Alarm and Control Loopback Detect Delta
Registers (RO)
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x00
0x00
0x0
0x00
0x00
0x00
0x10040
0x10041
0x10042
0x10043
0x10040
0x10041
0x10042
0x10043
15:4
15:8
15:8
15:8
3:0
7:0
7:0
7:0
RSVD
RSVD
RSVD
RSVD
Reserved.
Reserved.
Reserved.
Reserved.
The M13_DS1_AIS_DETx bits indicate when AIS is
detected on a low-speed data input, XC_DS1DATAx.
M13_DS1_AIS_DET[28:25]
M13_DS1_AIS_DET[24:17]
M13_DS1_AIS_DET[16:9]
M13_DS1_AIS_DET[8:1]
Address
Bit
Name
Function
Reset
Default
0x000
0x00
0x00
0x00
0x0
0x00
0x00
0x00
0x10044
0x10045
0x10046
0x10047
0x10044
0x10045
0x10046
0x10047
15:4
15:8
15:8
15:8
3:0
7:0
7:0
7:0
RSVD
RSVD
RSVD
RSVD
Reserved.
Reserved.
Reserved.
Reserved.
The M13_DS1_LB_DETx bits indicate when a loopback
request has been received through inversion of the third
C bit in received DS2 frames.
M13_DS1_LB_DET[28:25]
M13_DS1_LB_DET[24:17]
M13_DS1_LB_DET[16:9]
M13_DS1_LB_DET[8:1]
Address
Bit
Name
Function
Reset
Default
0x00
0x0
0x10049
0x1004A
0x1004B
0x1004C
0x10049
0x1004A
0x1004B
0x1004C
15:8
7
6:4
15:8
15:8
15:8
3:0
7:0
7:0
7:0
RSVD
M13_DS3_FLB_DETD
RSVD
RSVD
RSVD
RSVD
M13_DS1_FEAC_LB_DETD[28:25]
M13_DS1_FEAC_LB_DETD[24:17]
M13_DS1_FEAC_LB_DETD[16:9]
M13_DS1_FEAC_LB_DETD[8:1]
Reserved
.
This delta bit is set if M13_DS3_FLB_DET
(
Table 263 on page 216
) changes state. It can
be programmed to be either clear on read (COR)
or clear on write (COW), and it is not set to 1
again until another state transition occurs.
Reserved.
Reserved.
Reserved.
Reserved.
These individual delta bits are set as the result
of the corresponding state bits
M13_DS1_FEAC_LB_DET[28:1] (
Table 263 on
page 216
) transitioning either from 0 to 1 or from
1 to 0. Delta bits can be programmed to be
either clear on read (COR) or clear on write
(COW), and they are not set to 1 again until the
event reoccurs.
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相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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