參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 39/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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39
Agere Systems Inc.
Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
5 Timing Characteristics
Table of Contents
Contents
Page
5 Timing Characteristics ...................................................................................................................................... 39
5.1 TMUX Block Timing......................................................................................................................................41
5.2 DS3 Timing...................................................................................................................................................45
5.3 M13 Timing...................................................................................................................................................46
5.4 VT Mapper Timing........................................................................................................................................47
5.4.1 VT Mapper Lower-Order Path Overhead Interface Timing ............................................................... 47
5.5 Concentration Highway (CHI) Timing...........................................................................................................48
5.6 Parallel System Bus Timing .........................................................................................................................49
5.7 NSMI Timing (6-Pin) (to/from Framer)..........................................................................................................50
5.8 NSMI Timing (7-Pin) (to/from Framer)..........................................................................................................50
5.9 CHI Interface Timing ....................................................................................................................................51
5.10 PSB Interface Timing .................................................................................................................................52
5.11 Framer DS1/E1 Interface Timing................................................................................................................53
5.12 DJA DS1/E1 Interface Timing ....................................................................................................................54
5.13 M13 DS1/E1 Interface Timing ....................................................................................................................55
5.14 Microprocessor Interface Timing................................................................................................................56
5.14.1 Synchronous Mode ......................................................................................................................... 56
5.14.2 Asynchronous Mode ....................................................................................................................... 59
5.15 General-Purpose Interface Timing .............................................................................................................62
6 Ordering Information ........................................................................................................................................ 63
Figures
Page
Figure 6. Generic Clock Timing...............................................................................................................................41
Figure 7. Generic Interface Data Timing .................................................................................................................43
Figure 8. DS3DATAOUTCLK Timing ......................................................................................................................45
Figure 9. VT Mapper Transmit Path Overhead Detailed Timing .............................................................................47
Figure 10. VT Mapper Receive Path Overhead Detailed Timing ............................................................................47
Figure 11. CHI Transmit I/O Timing.........................................................................................................................48
Figure 12. CHI Receive I/O Timing..........................................................................................................................48
Figure 13. Parallel System Bus Interface Transmit I/O Timing................................................................................49
Figure 14. Parallel System Bus Interface Receive I/O Timing.................................................................................49
Figure 15. Microprocessor Interface Synchronous Write Cycle (MPMODE (Pin AD17) = 1)..................................56
Figure 16. Microprocessor Interface Synchronous Read Cycle (MPMODE (Pin AD17) = 1)..................................57
Figure 17. Microprocessor Interface Asynchronous Write Cycle Description (MPMODE (Pin AC18) = 0) .............59
Figure 18. Microprocessor Interface Asynchronous Read Cycle (MPMODE (Pin AC18) = 0)................................61
Tables
Page
Table 25. High-Speed Input Clock Specifications....................................................................................................41
Table 26. Output Clock Specifications.....................................................................................................................42
Table 27. Input Timing Specifications......................................................................................................................43
Table 28. Output Timing Specifications ...................................................................................................................45
Table 29. DS3 Input Clock Specifications................................................................................................................45
Table 30. Input Timing Specifications......................................................................................................................45
Table 31. Output Timing Specifications ...................................................................................................................45
Table 32. M13 Clock Specifications.........................................................................................................................46
Table 33. Input Timing Specifications......................................................................................................................46
Table 34. Output Timing Specifications ...................................................................................................................46
Table 35. VT Mapper Receive Path Overhead Detailed Timing..............................................................................47
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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