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參數(shù)資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態(tài)抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 96/784頁 |
| 文件大?。?/td> | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
96
Agere Systems Inc.
8 TMUX Registers
(continued)
Table 103. TMUX_RHS_CTL, Receive High-Speed Control Parameters (R/W)
Address
Bit
Name
Function
Reset
Default
0x000
0
0x40019
15:4
3
RSVD
Reserved.
TMUX_LOSEXT_LEVEL
Controls External LOSEXT Polarity.
0 = active-low.
1 = active-high.
TMUX_RPSMUXSEL1
Receive Protection Switch Control.
Control bit, when
set to a logic 1, causes the receive protection switch data
and clock inputs to be selected; otherwise, the normal
receive high-speed data input is selected.
TMUX_THS2RHSLB
Transmit High-Speed to Receive High-Speed Loop-
back Control.
Control bit, when set to a logic 1, causes
the transmit output STS-3/STM-1 (AU-4) signal to be
looped back to the receive input; otherwise, the loopback
is disabled.
TMUX_RHSDSCR
Receive High-Speed Descramble Enable.
Control bit,
when set to a logic 1, causes the input STS-3/STM-1
(AU-4) signal to be descrambled; otherwise, the signal is
not descrambled.
2
0
1
0
0
0
Table 104. TMUX_RLS_BITBLK_CTL, Receive Low-Speed Control Parameters (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
00
0x4001A
15:9
8:7
RSVD
Reserved.
TMUX_RCV_SS_EXP[1:0]
Expected Receive Pointer Size Bits Value.
Expected
value of incoming pointer SS bits.
TMUX_RCV_SS_ENB
Receive Size Bits Enable.
Control bit, when set to a logic
0, causes the received size bits to be ignored by the
pointer interpreter; otherwise, the received size bits must
equal the expected size bits or the received pointer value
will be invalid.
RSVD
Reserved.
TMUX_BITBLKG1
Receive Bit/Block Error Count Control.
Control bit,
when set to a logic 0, causes the receive error counter to
count bit errors; otherwise, count block errors (a block
equals one frame) occur.
TMUX_BITBLKM1
Receive Bit/Block Error Count Control.
Control bit,
when set to a logic 0, causes the receive error counter to
count bit errors; otherwise, count block errors (a block
equals one frame) occur.
TMUX_BITBLKB3
Receive Bit/Block Error Count Control.
Control bit,
when set to a logic 0, causes the receive error counter to
count bit errors; otherwise, count block errors (a block
equals one frame) occur.
TMUX_BITBLKB2
Receive Bit/Block Error Count Control.
Control bit,
when set to a logic 0, causes the receive error counter to
count bit errors; otherwise, count block errors (a block
equals one frame) occur.
TMUX_BITBLKB1
Receive Bit/Block Error Count Control.
Control bit,
when set to a logic 0, causes the receive error counter to
count bit errors; otherwise, count block errors (a block
equals one frame) occur.
6
0
5
4
0
0
3
0
2
0
1
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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