參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 363/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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363
Agere Systems Inc.
Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
16 Microprocessor Interface Functional Description
(continued)
5-9040(F)r.3
Figure 20. PM Reset Counter
The PM counter control signal controls the transfer and reset of all performance monitoring registers (collecting
events/statistics). The source of this signal is configurable and can come from external pin (PMRST pin T25), an
internal timer, or be controlled by software, depending on the SMPR_PMMODE[1:0] bits (
Table 77 on page 70
, bits
9:8), described as follows:
SMPR_PMMODE[1:0] = 00, 10: PM counter control is sourced from external pin PMRST.
SMPR_PMMODE[1:0] = 01: PM counter control is sourced from internal 1 s timer. Writing a logic 1 to the
SMPR_PMRESET bit (
Table 75 on page 68
, bit 8) will reset the timer so that a transition occurs on the internal PM
counter control signal within 10 MPCLK clock cycles. The timer is based on the period of the MPCLK and the pro-
grammed value of the registers in
Table 82 on page 73
and
Table 83
. Once initially reset and synchronized, the
PM counter reset interval is determined by the combined delay of the programmed registers. The device pin,
PMRST, is enabled as an output.
SMPR_PMMODE[1:0] = 11: The PM counter control signal is software controlled. Writing a logic 1 to the
SMPR_PMRESET bit will cause a PM reset within 10 MPCLK cycle times after writing. This pulse will be
100 cycles high and 100 cycles low at the MPCLK frequency. During this 200 cycle time, writing to PM bit will have
no effect. The device pin, PMRST, is enabled as an output.
5-9931(F)
Figure 21. PM Reset Signal Generation
PM COUNT EVENT
HOLDING
COUNTER
MPU READABLE
MPUCLK
MPU READ HOLDING
REGISTER
(ONE PER BLOCK)
PM COUNT EVENT CLOCK
RESET
PM COUNTER CONTROL
PM COUNTER
BUFFERED
ENABLE
RUNNING
COUNTER
MPUCLK
DELAY
1/2 SECOND
COUNTERS
SMPR_PMRESET_HIGH_COUNT
SMPR_PMRESET_LOW_COUNT
SMPR_PMMODE
(REGISTER SMPR_GCR bits[9:8])
SMPR_PMRESET
(REGISTER SMPR_GTR bit 8)
FREE RUNNING
(SMPR_PMMODE[1:0] = 01)
SOFTWARE CONTROLLED
(SMPR_PMMODE[1:0] = 11)
EXTERNAL
(SMPR_PMMODE[1:0] = 00, 10)
MPUCLK
OUTPUT ENABLED
SMPR_PMMODE[1:0] = 01, 11
OUTPUT DISABLED
SMPR_PMMODE[1:0] = 00, 10
PMRST (TO BLOCKS)
PMRSTO
PMRSTI
MPU BLOCK
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
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TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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