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參數(shù)資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態(tài)抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 208/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
208
Agere Systems Inc.
11 M13/M23 MUX/DeMUX Registers
(continued)
Table 235. M13_MASK5, Mask (R/W)
Address
Bit
Name
Function
Reset
Default
0x1000E 15:2
RSVD
Reserved
.
00000000000000
1
1
M13_DS2DMX_LOC_SM
Mask Bit.
Setting this mask bit high prevents the
summary delta M13_DS2DMX_LOC_SD
(
Table 230 on page 205
) from causing the block
output interrupt (INT) to be active.
M13_RDL_FIFO_UFM
Mask Bit.
Setting this mask bit high prevents
M13_RDL_FIFO_UFD (
Table 230 on page 205
)
from causing the block output INT to be active.
0
1
Table 236. M13_DS3_STATUS1, Status (RO)
Address
Bit
Name
Function
Reset
Default
0x00
1
0x1000F
15:8
7
RSVD
Reserved
.
This bit is set if 15 consecutive ones are received on the
path maintenance data link. it is cleared when a flag byte
is received.
This bit is set if M13_DS3_OOF is high continuously for 28
frame periods (approximately 3 ms). Once set,
M13_DS3_LOF is not cleared until M13_DS3_OOF is
continuously low for 28 frame periods.
The DS3 Framer Out Of Frame State Bit.
(See DS3
framer section on
page 476
.) This bit is high while out of
frame.
This bit is set if the first C bit of each DS3 frame is
received high for 8 consecutive frames. Once
M13_DS3_C1_DET is set, three consecutive frames with
C1 = 0 must be received before it is cleared.
If both X bits in two consecutive frames are received as 0,
the M13 sets this bit to 1. Once it is set, it is not cleared
until both X bits in two consecutive frames are received
as 1.
The 4704 information bits in each M frame are checked for
the presence of the AIS (1010) pattern. A pattern detection
bit is set if fewer than five pattern errors are received in
each of two consecutive frames. Once a bit is set, it is not
cleared until at least 16 pattern errors are received in each
of two consecutive frames.
M13_DS3_IDLEPAT_DET The 4704 information bits in each M frame are checked for
the presence of the idle (1100) pattern. A pattern detection
bit is set if fewer than five pattern errors are received in
each of two consecutive frames. Once a bit is set, it is not
cleared until at least 16 pattern errors are received in each
of two consecutive frames.
M13_DS3_CBZ_DET
This bit is set if every C bit in three consecutive DS3
frames is 0. It is cleared if the three C bits in a single
M-subframe are all 1.
M13_RDL_IDLE
6
M13_DS3_LOF
0
5
M13_DS3_OOF
1
4
M13_DS3_C1_DET
0
3
M13_DS3_RAI_DET
0
2
M13_DS3_AISPAT_DET
0
1
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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