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參數(shù)資料
| 型號(hào)： | T8302 |
| 英文描述： | T8302 Internet Protocol Telephone Advanced RISC Machine (ARM) Ethernet QoS Using IEEE 802.1q |
| 中文描述： | T8302因特網(wǎng)協(xié)議電話高級(jí)RISC機(jī)（ARM）的以太網(wǎng)使用IEEE 802.1q的服務(wù)質(zhì)量 |
| 文件頁(yè)數(shù)： | 18/248頁(yè) |
| 文件大?。?/td> | 7321K |
| 代理商： | T8302 |
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16
Agere Systems Inc.
T8302 Internet Protocol Telephone
Advanced RISC Machine (
ARM
)
Data Sheet
July 2001
1 Introduction
(continued)
1.2 IPT_DSP Features
The IPT_
ARM
is intended to be used with its companion IC, the audio digital signal-processor integrated circuit
(IPT_DSP). The combination of the IPT_
ARM
and the IPT_DSP provides a powerful solution for the implementa-
tion of the IP exchange business phone. The features of the IPT_DSP are as follows:
I
DSP1627 core with bit manipulation unit.
I
DSP clock speeds up to 80 MHz.
I
Instruction ROM, 32K x 16 (zero wait-state at 80 MHz).
I
Dual-port RAM, 6K x 16 (zero wait-state at 80 MHz).
I
Internal SRAM, 16K x 16 (single wait-state at 80 MHz).
I
16-bit analog-to-digital converter.
I
Programmable gain amplifier on audio input.
I
Fixed gain differential microphone input.
I
Analog input SRAM buffer, 512 x 16.
I
Timed DMA for analog input SRAM.
I
Two 16-bit digital-to-analog converters.
I
Independent simultaneous speaker and handset outputs.
I
Two integrated differential speaker driver outputs.
I
Two analog output SRAM buffers, 512 x 16 each.
I
Two timed DMA outputs for simultaneous handset and speaker audio output.
I
Low-pass filtering on audio inputs and outputs.
I
Serial I/O interface.
I
General-purpose timer counter.
I
Bit I/O interface.
I
JTAG test and debugging control.
I
Implementation in 0.35
μ
m, 5 V silicon technology.
I
Packaged in 100-pin TQFP
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參數(shù)描述 |
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