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參數(shù)資料
| 型號： | T8302 |
| 英文描述： | T8302 Internet Protocol Telephone Advanced RISC Machine (ARM) Ethernet QoS Using IEEE 802.1q |
| 中文描述： | T8302因特網(wǎng)協(xié)議電話高級RISC機(jī)（ARM）的以太網(wǎng)使用IEEE 802.1q的服務(wù)質(zhì)量 |
| 文件頁數(shù)： | 38/248頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | T8302 |
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Agere Systems Inc.
T8302 Internet Protocol Telephone
Advanced RISC Machine (
ARM
)
Data Sheet
July 2001
4 Reset/Clock Management
(continued)
Table 5 shows the format of the
pause register
.
4.2.2 Version ID Register
The version ID register contains the chip identification and version information for the device. This register is read
only. The format of the version ID register is shown in Table 6.
4.2.3 Clock Management Register
The
clock management register
selects the source of the clock to the chip blocks. Writing a 1 to a bit in this reg-
ister causes the clock switching logic to switch to the selected clock. If more than one bit is set, the lowest num-
bered bit takes precedence.
Regarding the
USBEXT
and
USBPLL
control bits: if both are set, then
USBEXT
takes precedence. For example, if
bits 1 and 0 are both written to 1, the clock switches to the
USB_ALT_CLK
. If all zeros are written, nothing hap-
pens.
CMRT
,
PLLC
, and
CMEC
control the source of the system clock. The system clock can be either the slow clock,
the PLL clock or the external 11.52 MHz crystal. Table 7 shows the format of the
clock management register
.
.
Table 5. Pause Register
Address 0xE000 0000
Bit #
Name
Bit #
31:1
31:1
RSVD
0
PAUSE
Name
RSVD
PAUSE
Description
Reserved.
Specifies if the system is in wait-for-interrupt (WFI) mode.
If 1, the system is in WFI mode.
If 0, the system is in normal mode.
0
Table 6. Version ID Register 0xE000 0010
Address 0xE000 0010
Bit #
Name
31:16
Device ID
15:0
Version ID
Bit #
31:16
15:0
Name
Device ID
Version ID
Description
These bits will always contain 0x8302.
These bits will contain the version identification of
the device.
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