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參數(shù)資料
| 型號(hào)： | T8302 |
| 英文描述： | T8302 Internet Protocol Telephone Advanced RISC Machine (ARM) Ethernet QoS Using IEEE 802.1q |
| 中文描述： | T8302因特網(wǎng)協(xié)議電話高級(jí)RISC機(jī)（ARM）的以太網(wǎng)使用IEEE 802.1q的服務(wù)質(zhì)量 |
| 文件頁(yè)數(shù)： | 58/248頁(yè) |
| 文件大?。?/td> | 7321K |
| 代理商： | T8302 |
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Agere Systems Inc.
T8302 Internet Protocol Telephone
Advanced RISC Machine (
ARM
)
Data Sheet
July 2001
6 Programmable Direct Memory Access (DMA) Controller
The programmable direct memory access (DMA) controller provides four independent high-speed DMA channels.
A DMA channel is used to transfer data between two memory locations more efficiently than under program control
of the
ARM
core. Data is transferred in bytes, half-words, or words. Each DMA channel maintains a 32-bit source
and destination address. Some DMA controller features are as follows:
I
Four DMA channels.
I
32-bit source and destination address pointers.
I
Up to 64K [bytes/half-words/words] transferred at a time.
I
Interrupt generation on DMA transfer completion.
I
Four external DMA request input signals to regulate transfers.
I
Operates in three modes (explained below).
I
Circular buffer mode.
5-9380 (F)
Figure 6. DMA Controller Block Diagram 1
6.1 DMA Operation
Figure 6 above and
Figure 7 on page 60
illustrate the functional blocks of the DMA controller. Each DMA channel
includes a 32-bit
DMA
source address register
(see Table 37 on page 64)
, a 32-bit
DMA destination address
register
(see Table 39 on page 64)
, a 16-bit
DMA transfer count register
(see Table 41 on page 65)
, and a
DMA
control register
(see Table 36 on page 62)
. Each DMA channel operates in one of the modes listed in the next
Section.
BRIDGE
INTERFACE
ASB INTERFACE
TO BRIDGE
TX_DRQ0 (ETHERNET)
APB INTERFACE
ASB (SYSTEM BUS)
DMA
CONTROL
LOGIC
TX_DRQ1 (IRDA)
TX_DRQ2 (UART)
TX_DRQ3 (SSI)
RX_DRQ0 (ETHERNET)
RX_DRQ1 (IRDA)
RX_DRQ2 (UART)
RX_DRQ3 (SSI)
APB (PERIPHERAL BUS)
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