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參數(shù)資料
| 型號： | T8302 |
| 英文描述： | T8302 Internet Protocol Telephone Advanced RISC Machine (ARM) Ethernet QoS Using IEEE 802.1q |
| 中文描述： | T8302因特網(wǎng)協(xié)議電話高級RISC機（ARM）的以太網(wǎng)使用IEEE 802.1q的服務質量 |
| 文件頁數(shù)： | 69/248頁 |
| 文件大?。?/td> | 7321K |
| 代理商： | T8302 |
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Agere Systems Inc.
67
Data Sheet
July 2001
T8302 Internet Protocol Telephone
Advanced RISC Machine (
ARM
)
6 Programmable Direct Memory Access (DMA) Controller
(continued)
Table 43. DMA Status Register
(continued)
Bit #
11
Name
CRF2
Description
Read fault on channel 2. Set by hardware when a read fault occurs during a DMA
transmission on channel 2.
Cleared by reset or writing a 1 to this bit.
Write fault on channel 2. Set by hardware when a write fault occurs during a DMA
transmission on channel 2.
10
CWF2
Cleared by writing a 1 to this bit.
Circular buffer reload counter, channel 2. If channel 2 is in circular buffer mode, the
hardware increments this by 1 each time the destination address is reloaded from the
corresponding
DMA preload destination start address register
(see Table 38 on
page 64)
.
9:8
PCNT2[1:0]
Cleared by reset or writing a 0x11 to these bits.
Read fault on channel 1. Set by hardware when a read fault occurs during a DMA
transfer on channel 1.
7
CRF1
Cleared by reset or writing a 1 to this bit.
Write fault on channel 1. Set by hardware when a write fault occurs during a DMA
transfer on channel 1.
6
CWF1
Cleared by reset or writing a 1 to this bit.
Circular buffer reload counter channel 1. If channel 1 is in circular buffer mode, the
hardware increments this by 1 each time the destination address is reloaded from the
corresponding
DMA preload destination start address register
(see Table 38 on
page 64)
.
5:4
PCNT1[1:0]
Cleared by reset or writing a 0x11 to these bits.
Read fault on channel 0. Set by hardware when a read fault occurs during a DMA
transfer on channel 0.
3
CRF0
Cleared by reset or writing a 1 to this bit.
Write fault on channel 0. Set by hardware when a write fault occurs during a DMA
transfer on channel 0.
2
CWF0
Cleared by reset or writing a 1 to this bit.
Circular buffer reload counter channel 0. If channel 0 is in circular buffer mode, the
hardware increments this by 1 each time the destination address is reloaded from the
corresponding
DMA preload destination start address register
(see Table 38 on
page 64)
.
1:0
PCNT0[1:0]
Cleared by reset or writing a 0x11 to these bits.
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